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文檔簡介

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3、a).ram_write);(ram_write)ram_inferU_ram_infer(.q(ram_rdata),.a(ram_addr),.d(ram_wdata).we(ram_write),.clk);(hclk)endmodulemoduleram_infer(q,a,d,we,clk);output31:0);q;input31:0d;input17:0a;inputwe;inputclk;reg31:0mem262143:0always(posedgeclk)beginif(we)beginmema=d;endendassignq=mema;endmodulemodulera

4、m_ahbif(hclkhresetn/ahbslavehsel_shaddr_shburst_shtrans_shrdata_shwdata_shwrite_shready_shresp_s/raminterfaceram_rdataram_addrram_wdataram_write);/declarationofinput&output/inputhclkinputhresetn/ahbslaveinterfaceinputhsel_sinput19:0haddr_sinput2:0hburst_sinput1:0htrans_sinput31:0hwdata_sinputhwrite_

5、soutput1:0hresp_soutput31:0hrdata_soutputhready_s/raminterfaceinput31:0ram_rdataoutput17:0ram_addroutput31:0ram_wdataoutputram_write/declarationofregisters&wires/wire1:0hresp_swire31:0hrdata_sreghready_swire31:0ram_wdatareg17:0ram_addrregram_writewirewr_enwirerd_enwireready_en/program&function/assig

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