CPLD在多路高速同步數(shù)據(jù)采集系統(tǒng)中的應用

CPLD在多路高速同步數(shù)據(jù)采集系統(tǒng)中的應用摘要采用語言設計，用控制模數(shù)轉(zhuǎn)換電路，完成多路模擬輸入的高速同步數(shù)模轉(zhuǎn)，具有容錯和自檢能力。與處理之間采用并行接口，具有很好的移植性、可靠性。關鍵詞高速同步數(shù)模轉(zhuǎn)換容錯和自檢并行接口移植性引言，復雜可編程邏輯器件是在傳統(tǒng)的、基礎上發(fā)展而來的，具有多種工作方式和高集成、高速、高可靠性等明顯的特點，在超高速領域和實時測控方面有非常廣泛的應用。與相比，比較適合計算機總線控制、地址譯碼、復雜狀態(tài)機、定時計數(shù)器、存儲控制器等密集型應用，且無須外部配置、時延可預測等。目前的普遍基于2和電可擦技術，可實現(xiàn)100次以上擦寫循環(huán)。部分支持編程或者配置有口，對于批量小、品種多的模板開發(fā)極為有利。而用設計的程序，借助工具可以行為仿真、功能仿真和時序仿真，最后通過綜合工具產(chǎn)生網(wǎng)表，下載到目標器件，從而生成硬件電路。范文先生網(wǎng)收集整理1系統(tǒng)設計原理及框圖以公司7000系列產(chǎn)品之一7128-10為控制核心，控制模數(shù)轉(zhuǎn)換電路，最多可完成32路模擬數(shù)據(jù)的16位高速同步轉(zhuǎn)換。圖1為與轉(zhuǎn)換電路相關的系統(tǒng)外圍電路框圖。外部32路模擬輸入通過調(diào)理電路后，控制多路切換器選通某一路信號送入轉(zhuǎn)換器676進行轉(zhuǎn)換，轉(zhuǎn)換結(jié)果經(jīng)過數(shù)據(jù)緩沖在合適的時候通過總線被讀入處理器。一般的設計思路如下①主處理器直接控制轉(zhuǎn)換電路，完成模擬輸入信號的采集保持、轉(zhuǎn)換器的控制、通道的切換、數(shù)據(jù)的讀取以及控制注入信號完成模擬通道的自檢等。這種解決方案占用主處理器大量的資源和處理時間，在高速采集與大計算量的時實系統(tǒng)中是不可取的一方面因為處理器的資源極其有限，同時乂要求大量的匯編軟件配合，不利于設計的移植；另一方面由于頻繁地執(zhí)行操作完成相對定時關系，來實現(xiàn)高速數(shù)據(jù)采集，不利于系統(tǒng)調(diào)度軟件的設計的其它軟件模塊的時實執(zhí)行，由于此段操作類似于原子操作，很難解決其它模塊響應時間可能較長的矛盾。②采用其它廉價的從處理器，如51單片機來控制上述過程，使之與主處理器并行化。但此時從處理器與主處理器之間的高速數(shù)據(jù)實時交換就成為瓶頸，而且由于51單片機亦為軟件化流程控制，存在跑飛的可能，兩處理器的同步乂成為新的問題。應用器件就可以很好地解決上述矛盾，實現(xiàn)配置隨意可改寫和高速硬件流控制等。隨著器件的發(fā)展，已經(jīng)日益廣泛地應用到高速數(shù)據(jù)采集系統(tǒng)中，但都是很考慮設計本身的容錯、自檢能力和使用的靈活性，不利于故障的定位和嵌入式應用的移植。本設計中采用作為轉(zhuǎn)換電路的控制器，和主處理器并行交互數(shù)據(jù)，很好地解決了上述矛盾。為突出重點，7128、676、398等器件的簡介此處不作介紹，僅列出676的控制時序，如圖2所示。圖2多路模擬信號的同步采樣一般有兩種實現(xiàn)方法一種為多個轉(zhuǎn)換器同時進行轉(zhuǎn)換；另一種為僅有一個轉(zhuǎn)換器，各通道同時采樣，然后分時轉(zhuǎn)換?？紤]到16位高速轉(zhuǎn)換器676的價格因素，采用后一種方案。676有三個控制信號、、。它們需要一定的時序配合才能正常工作，如圖2所示。由于676的轉(zhuǎn)換結(jié)果不具備三態(tài)輸出功能，所以需增加74574和總線進行隔離，為此配置控制信號、；同時要考慮到32路模擬信號的采樣保持控制、多路切換器的控制信號14~10，以及輸入模擬信號選擇01~10、數(shù)據(jù)準備好信號1等共14個。和處理器采用并行接口，因此其輸入信號有系統(tǒng)復位信號、處理器的讀寫信號、片選信號、外部時鐘輸入、輔助地址信號20~17和5~0、676的反饋輸入，共22個輸入。外加雙向數(shù)據(jù)總線07~00o設計中沒有將總線隔離器74574集成到中，主要考慮到保留適當?shù)牡荣Y源用于系統(tǒng)的地址譯碼和其它輔助功能。地址譯碼等輔助模塊比較簡單且與特定的處理器相關，故此處不作介紹。雖然有復位默認值，但為靈活控制多路模擬量的同步轉(zhuǎn)換，要求處理器正確設置兩個控制參數(shù)，即進行數(shù)模轉(zhuǎn)換的模擬量通道的總個數(shù)和數(shù)模轉(zhuǎn)換的初始通道號；然后再對寫入啟動轉(zhuǎn)換命令，這樣即可脫離處理器，控制轉(zhuǎn)換電路。首先按照398的時序要求產(chǎn)生其所需的采樣保持信號完成32路模擬量的同步采樣，然后按照圖2所示的通常轉(zhuǎn)換時序控制676去完成一次轉(zhuǎn)換。一旦該次轉(zhuǎn)換完成，使能信號，鎖存轉(zhuǎn)換結(jié)果到74574,并發(fā)出數(shù)據(jù)準備好信號1，同時標識內(nèi)部狀態(tài)信號，作為中斷請求通知處理器，或者供處理器查詢狀態(tài)。將一直等待處理器將該次轉(zhuǎn)換結(jié)果取走才取消此標示信號。在等待的過程中，處理器亦可命令提前結(jié)束轉(zhuǎn)換，以適應不同的應用要求。轉(zhuǎn)換結(jié)果取走后，清除內(nèi)部的標識信號和數(shù)據(jù)準備好信號，的映像減1，若不為0，的映像加1，輸出到1[40]去切換至下一通道，繼續(xù)按照圖2所示的通常轉(zhuǎn)換時序工作；若為0，則該次采樣轉(zhuǎn)換完成，等待處理器的下一次啟動信號。這樣，只占用了處理器的一個中斷請求資源和少數(shù)外部空間，就實現(xiàn)了最多至32路模擬信號的同步高速數(shù)模轉(zhuǎn)換。為使設計具有一定的容錯功能，在轉(zhuǎn)換器空閑時，處理器才可以啟動自校準測試，但此時應該防止處理器誤啟動轉(zhuǎn)換。當轉(zhuǎn)換器空閑或者自校準已經(jīng)結(jié)束時，處理器才可以進行轉(zhuǎn)換工作。同樣，此時應該防止處理器誤啟動自校準。為使能支持處理器的檢錯功能3,應該使以及轉(zhuǎn)換器的狀態(tài)信息可以被處理器隨時讀取，以便在系統(tǒng)級上定位故障。同時，可以選擇調(diào)理電路的模擬輸入信號源，便于處理器檢測調(diào)理電路。圖3為達到以上的功能，在設計中主要設置了四大功能模塊，分別為時鐘分頻模塊、控制譯碼模塊、總線接口模塊、狀態(tài)機模塊，設計原理如釁3所示。時鐘分頻模塊用于產(chǎn)生767的轉(zhuǎn)換時鐘。為簡化設計，達到高速和簡化的目的，此模塊的分頻系數(shù)由設計固化。控制信號譯碼模塊用于完成處理器對片內(nèi)模塊的尋址和譯碼，為一簡單譯碼邏輯和觸發(fā)電路?？偩€接口模塊用于完成處理器和轉(zhuǎn)換控制器的數(shù)據(jù)交換；同時完成767的自校準信號的控制，如圖2所示的自校準時序。需要注意一點的是，在自校準的過程中，信號必須保持低電平，否則出錯。狀態(tài)機模塊用于產(chǎn)生轉(zhuǎn)換的時序，如圖2所示的通常轉(zhuǎn)換時序。在轉(zhuǎn)換的過程中，信號必須保持低電平，否則出錯；狀態(tài)機模塊同時完成對多路切換器的控制。圖2所示的各信號的相對定時關系此處不作說明，請查閱676的數(shù)據(jù)手冊。為達到圖2所示、時序的相互閉鎖關系，從狀態(tài)機模塊引出其內(nèi)部狀態(tài)信號到總線接口模塊，一方面，狀態(tài)機的狀態(tài)可以隨時被處理器感知;另一方面用于閉鎖信號，即閉鎖自校準。詳細地說，就是在轉(zhuǎn)換期間，在圖2所示的通常轉(zhuǎn)換時序中，從變高到信號再次變低以前，即使處理器再次寫入了啟動自校準命令，亦閉鎖信號的產(chǎn)生。為便于安全啟動信號，在本次轉(zhuǎn)換完成或全部轉(zhuǎn)換完成時，滿足一定的相對時序即可啟動。同理，將總線接口模塊內(nèi)控制信號的狀態(tài)機的狀態(tài)引入狀態(tài)機模塊，用于在自校準期間，閉鎖信號的產(chǎn)生，即閉鎖處理器啟動轉(zhuǎn)換的命令。這樣，轉(zhuǎn)換控制器就具有很好的容錯能力。無論何時，處理器都可以通過讀取、、、中斷請求、狀態(tài)機的狀態(tài)，來監(jiān)測、676等的工作和判斷損壞與否。通過處理器的配合就使支持系統(tǒng)的在線自檢，解決了以往類似設計中存在錯誤而處理器乂無法進行故障定位的問題。圖42系統(tǒng)仿真和驗證以上設計用語言描述完成后，首先在51環(huán)境下進行編譯、綜合、適配后再時序仿真；但這只是純邏輯驗證，此時時序仿真圖中沒有包含任何硬件延遲信息。結(jié)果正確后，在+100環(huán)境下進行編譯、綜合、適配后，再進行時序仿真驗證。由于考慮了硬件因素，選擇7000系列的712810010器件后，該器件的擺率位必須選中，否則在高速時鐘輸入時，的仿真結(jié)果不正確。圖4即為在下的時序仿真結(jié)果，模擬40的時鐘輸入和主處理器50的外部存儲器訪問周期，可以達到676的最快轉(zhuǎn)換速度。實際電路也驗證了這一點?？紤]到也完成系統(tǒng)的一部分譯碼功能，此時，所產(chǎn)生的報告文件表明資源利用情況，如表1所列。在文章的最后詳細給出了狀態(tài)機模塊的時序電路的設計程序。表1邏輯陣列塊邏輯單元引腳共享擴展項外部互連1-168165010101008165027367517-321616100101010015169323366333-4816161008108014168721365849-64151693710706163729368065-8016161000100016023366381-916161001010100161610031368697-1121516939109051631283677113-12816161008108061637293680使用的專用輸入引腳11425使用的引腳628077使用的邏輯單元11812892使用的共計擴展項521280