數(shù)字電路期末總復習知識點歸納詳細復習課程

數(shù)字電路期末總復習

知識點歸納詳細

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第1章數(shù)字邏輯概論一、進位計數(shù)制

1.十進制與二進制數(shù)的轉(zhuǎn)換

2.二進制數(shù)與十進制數(shù)的轉(zhuǎn)換

3.二進制數(shù)與16進制數(shù)的轉(zhuǎn)換

二、基本邏輯門電路

第2章邏輯代數(shù)

表示邏輯函數(shù)的方法，歸納起來有：真值表，函數(shù)表達

式，卡諾圖，邏輯圖及波形

圖等幾種。

一、邏輯代數(shù)的基本公式和常用公式

1)常量與變量的關(guān)系A(chǔ)+0=A與A1A

A+1=1與AO0

AA=1與AA=0

2)與普通代數(shù)相運算規(guī)律

a.交換律：A+B=B+A

ABBA

b.結(jié)合律：(A+B)+C=A+(B+C)

(AB)CA(BC)

C.分配律：A(BC)=ABAC

ABC(AB)()AO)

3)邏輯函數(shù)的特殊規(guī)律

a.同一律：A+A+A

b.摩根定律：ABAB,ABAB

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b.關(guān)于否定的性質(zhì)八=A

二、邏輯函數(shù)的基本規(guī)則代入規(guī)則

在任何一個邏輯等式中，如果將等式兩邊同時出現(xiàn)某一變量A

的地方，都用一個函數(shù)L

表示，則等式仍然成立，這個規(guī)則稱為代入規(guī)則

例如：ABCABC

可令L_=BC

則上式變成ALAL=ALABC

三、邏輯函數(shù)的：——公式化簡法

公式化簡法就是利用邏輯函數(shù)的基本公式和常用公式化簡

邏輯函數(shù)，通常，我們將

邏輯函數(shù)化簡為最簡的與一或表達式

1)合并項法：

利用A+AA1或ABABA,將二項合并為一項，合并時可消

去一個變量

例如：L=ABCABCAB(CC)AB

2)吸收法

利用公式AABA,消

去多余的積項，根據(jù)代入規(guī)則AB可以是

任何一個復雜的邏

輯式

例如化簡函數(shù)L=ABADBE

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解：先用摩根定理展開：AB=AB再用吸收法

L=ABADBE

=ABADBE

=(AAD)(BBE)

=A(1AD)B(1BE)

AB

3)消去法

利用AABAB消去多余的因子

例如，化簡函數(shù)L.=ABABABEABC

解：L=ABABABEABC

=(ABABE)(ABABC)

=A(BBE)A(BBC)

=A(BC)(BB)A(BB)(BC)

二A(BC)A(BC)

=ABACABAC

=ABABC

4）配項法

利用公式ABACBCABAC

將某一項乘以（AA）,即乘以

1,然后將其折成幾

項，再與其它項合并。

例如：化簡函數(shù)I-=ABBCBCAB

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解：L=ABBCBCAB

=ABBC(AA)BCAB(CC)

=ABBCABCABCABCABC

=(ABABC)(BCABC)(ABCABC)

=AB(1C)BC(1A)AC(BB)

=ABBCAC

2.應用舉例

將下列函數(shù)化簡成最簡的與一或表達式

1)L=ABBDDCEDA

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2)L二ABBCAC

3)L二ABACBCABCD

解：1)L=ABBDDCEDA

=ABD(BA)DCE

=ABDBADCE

=ABDABDCE

=(ABD)(ABAB)DCE

=ABDDCE

=ABD

2)L=ABBCAC

二AB(CC)BCAC

二ABCABCBCAC

二AC(1B)BC(1A)

二ACBC

3)L二ABACBCABCD

=ABACBC(AA)ABCD

=ABACABCABCABCD

=(ABABCABCD)(ACABC)

=AB(1CCD)AC(1B)

二ABAC

排列的，在與一或表達式的基礎(chǔ)上，畫卡諾圖的步驟是:

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四、邏輯函數(shù)的化簡一卡諾圖化簡法：

卡諾圖是由真值表轉(zhuǎn)換而來的，在變量卡諾圖中，變量的

取值順序是按循環(huán)碼進行

排列的，在與一或表達式的基礎(chǔ)上，畫卡諾圖的步驟是:

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，畫出給定邏輯函數(shù)的卡諾圖，若給定n個變量，表示卡諾圖矩形小方塊有

函數(shù)有

2"個。

2.在圖中標出給定邏輯函數(shù)所包含的全部最小項，并在最

小項內(nèi)填

1,剩余小方塊

填0.

用卡諾圖化簡邏輯函數(shù)的基本步驟：

1.畫出給定邏輯函數(shù)的卡諾圖

2.合并邏輯函數(shù)的最小項

3.選擇乘積項，寫出最簡與一或表達式選擇乘積項的

原則：

①它們在卡諾圖的位置必須包括函數(shù)的所有最小項②

選擇的乘積項總數(shù)應該最少

③每個乘積項所包含的因子也應該是最少的BC

BC

_ACI01011^110

例1.用卡諾圖化簡函數(shù)L=ABCABCABCABC1|1|1

解：1.畫出給定的卡諾圖

2.選擇乘積項：L=ACBCABC

例2.用卡諾圖化簡L=F(ABCD)BCDBCACDABC

00

01

11

10

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解：1.畫出給定4變量函數(shù)的卡諾圖AB00011110

2.選擇乘積項

設到最簡與或表達式I-=BCABDABC

例3.用卡諾圖化簡邏輯函數(shù)

L=m(1,3,4,5,7,10,12,14)

AB00011110

00m'milT131m?

解：1.畫出4變量卡諾圖01mdm1mdm，

11mum13IT115m

10m*m'ITm

2.選擇乘積項，設到最簡與一或表

達式

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L=ADBCDACD

第3章邏輯門電路

門電路是構(gòu)成各種復雜集成電路的基礎(chǔ)，本章著重理解TTL和

CMOS兩類集成電

Vo

AB

1.TTL與CMOS的電壓傳輸特性「I

_VNL'

0.51

4c08

0.3

\/ai\lnr-r-

開門電平VON一保證輸出為額定低電平

在標準輸入邏輯時，VON=1.8V

關(guān)門VOFF一保證輸出額定高電平90%的情

況下，允許的最大輸入低電平值，在標準

VoFF=0.8V

%L一為邏輯0的輸入電壓典型值VIL=0.3V

VIH—為邏輯1的輸入電壓典型值VIH=3.0V

VOH—為邏輯1的輸出電壓典型值VOH=3.5V

VOL—為邏輯0的輸出電壓典型值VOL=0.3V

對于TTL:這些臨界值為VOHmin2.4V,VOL皿0.4V

VIHmin2.0V,VlLmax0.8V

低電平噪聲容限：VNLVOFFVIL

高電平噪聲容限：VNHVIHVON

例：74LS00的VOH（min）2.5VVOL（出最?。?.4V

VIH（min）2.0VVIL（max）0.7V

=

它的導I電平噪聲容限VNHVIHVON=3—1.81.2V

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它的低電平噪聲容限VNLVOFFVIL=O.8-0.3=0.5V

2.TTL與COMS關(guān)于邏輯0和邏輯1的接法

74HC00為CMOS與非門采用+5V電源供電，

輸入端在下面四種接法下都屬于邏輯

①輸入端接地

②輸入端低于1.5V的電源

③輸入端接同類與非門的輸出電壓低于0.1V

④輸入端接10K電阻到地

74LS00為TTL與非門，采用+5V電源供電，采

用下列4種接法都屬于邏輯1

①輸入端懸空

②輸入端接高于2V電壓

③輸入端接同類與非門的輸出高電平3.6V

④輸入端接10K電阻到地

第4章組合邏輯電路

一、組合邏輯電路的設計方法

根據(jù)實際需要，設計組合邏輯電路基本步驟如下：

1.邏輯抽象

①分析設計要求，確定輸入、輸出信號及其因果關(guān)系

②設定變量，即用英文字母表示輸入'輸出信號

③狀態(tài)賦值，即用0和1表示信號的相關(guān)狀態(tài)

④列真值表，根據(jù)因果關(guān)系，將變量的各種取值和相應的函數(shù)值用

一張表格一一列

舉，變量的取值順序按二進制數(shù)遞增排列。

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①輸入變量少時，用卡諾圖

②輸入變量多時，用公式法

3.寫出邏輯表達式，畫出邏輯圖

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①變換最簡與或表達式，得到所需的最簡式-------------------

②根據(jù)最簡式，畫出邏輯圖

例，設計一個8421BCD檢碼電路，要

求當輸入量ABCD<3或>7時，電路輸出為高電

平，試用最少的與非門實現(xiàn)該電路。

解：1.邏輯抽象

-①分由題意，輸入信號是四位8421BCD碼為十進制，輸出為

局I、低電平；

②設輸入變量為DCBA,輸出變量為!_；

③狀態(tài)賦值及列真值表

ABCbL

00001

00011

00101

00110

1101

01000

0000

01h0

0100

11

01110

10001

10011

1010

1011

1100

1101

111

111

2.化簡

由于變量個數(shù)較少，幫用卡諾圖化

簡

3.寫出表達式

經(jīng)化簡，得到LABDABC

4.畫出邏輯圖

二、用組合邏輯集成電路構(gòu)成函數(shù)

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①74LS151的邏輯圖如右圖圖中，E為輸入使能

端，低電平有效S2S3為地址輸入端，

D0~D7為數(shù)據(jù)選擇輸入端，Y、Y互非的輸出端，其菜單如下表。

Y=DoS2S1S0D1B2SSSSS0...D7S2S1S0

i7

Yi-miDi

iO

其中mi為S2S1S0的最小項

Di為數(shù)據(jù)輸入

當Di=1時，與其對應的最小項在表達式中出現(xiàn)

當Di=0時，與其對應的最小項則不會出現(xiàn)

利用這一性質(zhì)，將函數(shù)變量接入地址選擇端，就可實現(xiàn)組合邏輯函

數(shù)。

②利用入選一數(shù)據(jù)選擇器74LS151產(chǎn)生邏輯函數(shù)LABC

ABCAB

解：1)將已知函數(shù)變換成最小項表達式

ABCABCAB

ABCABCAB(CC)

ABCABCABCABC

2)將LABCABCABCABC轉(zhuǎn)換成74LS151對應的輸出形式Y(jié)i=m.Di

iO

在表達式的第1項ABC中A

為反變量，B、C為原變量，故ABC=011m3

在表達式的第2項ABC,中AvC為反變量，為B

原變量，故ABC=101FT15

74LS151

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同理ABC=111ni7ABC=iioni6E

Do

Di

這樣L=m3D3m5D5m6D6m7D7

D2

D3L

將74LS151中mD3、D5、D6、D7取D41

D5

D6

即D3D5D6D7=1

ABC

1

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Do、DHD2、D4取0,即DoDiD2D4=0

ABCABCABCABC的邏輯圖如下圖示。

第5章鎖存器和觸發(fā)器

一、觸發(fā)器分類：基本R-S觸發(fā)器、同步RS觸發(fā)器、同

步D觸發(fā)器、

主從R-S觸發(fā)器、主從JK觸發(fā)器、邊沿觸發(fā)器

｛上升沿觸發(fā)器（D觸發(fā)器、JK

觸發(fā)

器）、下降沿觸發(fā)器（D觸發(fā)器、JK觸發(fā)器）

二'觸發(fā)器邏輯功能的表示方法

觸發(fā)器邏輯功能的表示方法，常用的有特性表、卡諾圖'特性方程'狀

態(tài)圖及時序圖。

對于第5章表示邏輯功能常用方法有特性表，特性方程及時序圖

對于第6章上述5種方法其本用到。

三'各種觸發(fā)器的邏輯符號、功能及特性方程

1.基本R-S觸發(fā)器邏輯符號邏輯功能

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特性方程：so若R1,S0,則Q"10

Qn1SRQn若R0,S0,貝Qn,1

R*n1妁市條性）若R1,S0,貝ljQn1Qn

若R1,S1,則QQ=1（不

允許出現(xiàn)）

2.同步RS觸發(fā)器

Q"SRQ。（CP=1,期間有效），

若R1,S0,貝IjQnl0

Rs0（約束條件）

若R0,SO,貝ljQn1

若R1,S1,貝QQ=1處于不穩(wěn)定狀

態(tài)

3□

同

步

D

觸

發(fā)

器

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特性方程Q?！疍（CP=1期間

有效）

4.主從R-S觸發(fā)器

特性方程CTSRQ"（作用后

）sSitiO0

CP

RRMQQ

RS0約束條件

邏輯功能

若R1,S0,CP作用后，Qn,0

若R0,S1,CP作用后，Qn’1

若R0,S0,CP作用后，Qn1

Qn

若R1,S1,CP作用后，處于不穩(wěn)定狀態(tài)

Note:CP作用后指CP由0變?yōu)?,再由

1變?yōu)?。時

5.主從JK觸發(fā)器

Qn'JQnKQn（CP作用

：r

后）c

K|

筍J1,K0,CP作用后，Qn,1

若J0,K1,CP作用后，Qn，

若J1,K0,CP作用后，Qn,0n（保持）

若J1,K1,CP作用后，Qn）（T（翻轉(zhuǎn)）7.邊

沿觸發(fā)器

如沿觸發(fā)器指觸發(fā)器狀態(tài)發(fā)生翻轉(zhuǎn)在CP產(chǎn)生跳變時刻

發(fā)生，

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邊沿觸發(fā)器分為:上升沿觸發(fā)和下降沿觸發(fā)

0DQQ

1）邊沿D觸發(fā)器①上升沿D觸發(fā)器CP—__

QQ

其特性方程Qn，D（CP上升沿到

來時有效）

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再特性方程

1Qn1D（CP下降沿到來時有

效）

邊沿JK觸發(fā)器

耀弊蠢覆觸發(fā)就

（CP上升沿到來時有效

6下降沿3K晶舞

其特性方程Qn1JQnKQn

（CP下降沿到來時有效)CPJJ00

劭上牌蝌觸發(fā)器

其特性方程Q"

：TQ。（CP上升沿到來時有效

：）

昌特性方程

；：Q"TQ"（CP下降沿到來時有效

J）

1

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1

1

勃始狀態(tài)為

0

I

其特性方程為=CP=AQn

-I、QLD=Q"(CP下降沿到來

百寸ti時刻存刖Qn1,Qn=0,A

i=0

1CP=B=00=0

I

I

.七Qn0,A=

亥ICP=B=10=10no不

至l變

果0,Q-0,故B=CP=0,當CP由1變?yōu)?時，Q[=0

ftQ

1

j

I至bn'1,而A=0CP=1

1

I時收集于網(wǎng)絡，如有侵權(quán)請聯(lián)系管理員刪除

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t3時刻到來時，A=1,Q-1CP二Acr二0

CP=0時，Qn1Qn=0

Qn,0時，由于A=1,故CP=AQn=1

圖B

若電路如圖C所示，設觸發(fā)器初始

狀態(tài)為0,C的波形如圖D所示，試畫出Q及B

2.UU

”而

當特性方程Q"D=Q"（CP下降沿有效）

七時刻之前，A=0,Q=0,CP=B二AQM

七時刻到來時A=1,Qn0故CP二B二AQ"

100

當CP由1變?yōu)?時，Qn,Qn=1

當Qn=1時，由于A=1,故CP=11,Qn不變

t2時刻到來時，A=0,Q"=1,故CP二B二A10

此時，CP由1變?yōu)?。時，Qn1Qn=0

當Q"=0時，由于A=0故CP=00=1

t3時刻到來時，由于A=1,而Qn=0,故CP=AQn

0

當CP由1變?yōu)?時，Qn,Q"=1

當Q=1時，由于A=1,故CP=B=111

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例：試寫出如圖示電路的特性方程，并畫出如圖示給定

信號

CP

、A、B作用下Q端

0.

B

CP

解：由題意該觸發(fā)器為下降沿觸發(fā)器JK觸發(fā)器其特性方程

Qn1JQnKQn（CP下降沿到來時有效）

其中JABKAB

JK觸發(fā)器功能：

J=1,K=0CP作用后Q"11

J=0,K=OCP作用后Q"10

J=0,K=OCP作用后Q01Qn

J=1,K=1CP作用后Qn1Qn

第6章時序邏輯電路分類

一、時序邏輯電路分類

時序邏輯電路分為同步時序邏輯電路和異步時序邏輯電路，時序邏輯電路通

常由組合

邏輯電路和存貯電路兩部分組成。

二'同步時序電路分析

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分析步驟：①確定電路的組成部分

②確定存貯電路的即刻輸入和時序電路的即刻輸出邏輯式

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③確定電路的次態(tài)方程

④列出電路的特性表和驅(qū)動表⑤由特性表和驅(qū)動表畫出狀態(tài)轉(zhuǎn)換圖

⑥電路特性描述。

例：分析如下圖示同步時序電路的邏輯功能

解：①確定電路的組成部分

該電路由2個上升沿觸發(fā)的T觸發(fā)器和兩個與門電路組成的

時序電路②確定存貯電路的即刻輸入和時序電路的即刻輸出

存貯電路的即刻輸入：對于FFo：ToA

對于FFi:ToAQon

時序電路的即刻輸出：IAQfQon

③確定電路的狀態(tài)方程

對于FFo:Qon,AQon

對于FFi:Qin1(AQon)Qin

④列出狀態(tài)表和真值表

由于電路有2個觸發(fā)器，故可能出現(xiàn)狀態(tài)分別

為00、01、10、11

n+1n+1n+1n+1

nn

設SoQoQo00nnnn

QiQo2QiQoz

QiQoQiQo

nn

SiQoQo01A-C\-1A=nA=I

00000010SoSo0Si0

nn

S2QiQo10

01010100SiS10S20

n

S301Q。"1110100110S2S20S30

收

1110001S3S30So1

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⑤電路狀態(tài)圖為

⑥電路的特性描述

由狀態(tài)圖，該電路是一個可控模4加法計數(shù)器，當A=1時，在

CP上升沿到來后電路狀

態(tài)值加1,一旦計數(shù)到11狀態(tài)，丫二1,電路

狀態(tài)在下一個CP上升沿加到00,輸出信號

Y下降沿可用于觸發(fā)器進位操作，當A=0時停止計數(shù)。

例：試分析下圖示電路的邏輯功能

bad8b

解：①確定電路的組成部分

該電路由3個上升沿觸發(fā)的D觸發(fā)器組成

②確定電路的太方程

n1n

對于FFo：QoDoQ2（CP上升沿到來有效）

對于FFi：Qin1DiQon（CP上升沿到來有效）

ln

對于FF2：Q2nD2Qi（CP上升沿到來有效）

③列出狀態(tài)轉(zhuǎn)換真值表

r>4-1

n,dOnnoDiOnQoOnDoOn

000001SoSi

001011SiS3

Q10101S2S5

011111S3S7

A00000。4C-

101010S5S2

11010收集于網(wǎng)S6S4

111110S7S6

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④由狀態(tài)表轉(zhuǎn)換真值表畫出如下圖示狀態(tài)圖

So\Si、S3、S7、S6、S4這6個狀態(tài),

形成了主循環(huán)電路，S2、S5為無效循環(huán)

⑤邏輯功能分析

由狀態(tài)圖可以看出，此電路正常工作時，每經(jīng)過6個時鐘脈沖作用后，

電路的狀態(tài)循環(huán)

一次，因此該電路為六進制計數(shù)器，電路中有2個無效狀態(tài)，構(gòu)成無效循

環(huán)，它們不能

自動回到主循環(huán)，故電路沒有自啟動能力。

三'同步時序電路設計

同步時序設計一般按如下步驟進行：

1）根據(jù)設計要求畫出狀態(tài)邏輯圖；

2）狀態(tài)化簡；

3）狀態(tài)分配；

4）選定觸發(fā)器的類型，求輸出方程、狀態(tài)方程和驅(qū)動方程；

5）根據(jù)方程式畫出邏輯圖；

6）檢查電路能否自啟動，如不能自啟動，則應采取措施加以解決。

例：用JK觸發(fā)器設計一同步時序電路，其狀態(tài)如下表所示，分析如圖示

同步時序電

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路。

nnn+1一卅y

A二0A=1

0001/011/0

0110/000/0

1011/001/0

1100/110/1

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解:

由題意，狀態(tài)圖已知，狀態(tài)表已知。故進行狀態(tài)分配及求狀態(tài)方程，輸

出方程。

由于有效循環(huán)數(shù)NM,設觸發(fā)器個數(shù)為K,則324得

到K=2.

故選用2個JK觸發(fā)器，將狀態(tài)表列為真值表，求狀態(tài)方程及輸出方程。

A]n+1Q2n+1Ynn

*Q1Q0

000010011110

nn1W

001100000101Q0

0101101001

011001Qn'的卡供

100110n

0

101000圉?

110010010o1n+1n

QoQo

11110111001

Q尸的卡偌圖:

nn

Q1Q0

-r-fH-I44I

0101

1010

n1nnnnnn

QiAQiQoAQiQoAQiQoAC

二(AQ0nAQon)Qin(AQonAQon)Qi"

=(AQon)Qin(AQon)Qr

將Qi"1Qon

Qin，(AQo")Qi"(A?分別寫成JK觸發(fā)器的標準形

式：

Q,n'JQnKQn

對于FFo：Qon11Qon1Qon

得到Jo=1,Ko=1

對于方程Ch"'(AQon)Qin(AQon)Qin

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得到Ji=AQon

Ki-AQon

畫出邏輯圖，選用上升沿觸發(fā)的

VCC

第八章脈沖波形的變換與GND放

產(chǎn)生I電

155閥

555定時器及其應用’

I5值

I

1.電路結(jié)構(gòu)及工作原理,控

制

555定時器內(nèi)部由分壓器、22b

）電

電壓比較器、RS鎖存器（觸發(fā)壓

器）輛引腳

22b）中,圖

集電極開路罐的糖船T等三部

分組成，

8引腳芯卡，放電三

裁管那結(jié)椅度示意圖如圖

22a）、

蹈提供放電通路，在

使用定時

所示。,

器時，該三極管集電控制電

.壓

極UVCO

'入；閥值輸

f入

（第7腳）一般要彳

VO

接上拉電阻，：H

U

觸發(fā)輸U

吊2入

G為反相比較器，02f產(chǎn)

為同相?,

比較器，比較器的基I'

準電壓由!

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電源電壓Vcc及內(nèi)部電阻分壓

比決定，在控制Vco（第5腳）

21

懸寸，VRIVCC'VR2VCC；

1,2,

如果第5腳外接控制電壓，

1

則VR,VCO、VR1Vco,Rd端（第4腳）是復位端，只要Rd

端加上低電平，輸出端（第3腳）立

12,

即被置成低電平，不受其它輸入狀態(tài)的影響，因此正常工作時必須使Rd端接高電平。

由圖22a）,Gi和G2組成的RS觸發(fā)器具有復位控

制功能，可控制三極管T的導通和截止。

由圖22a）可知，

2

2

當Vii>VRl（即Vii>Vcc）時，比較器G輸出VRO

3

1

當Vi2>Vfb（即Vi2'Vcc）時，比較器C2輸出Vs1

2,

RS觸發(fā)器Q=0

G3輸出為高電平，三極管T導通，輸出為低電平（VoO）

21

當V“<VR,（即VM<2VcC）,Vi2Me時，比較器G輸

出局電平，VR1,C2輸出為低電平Vs0

'33

基本RS觸發(fā)器Q=1,G3輸出為低電平，三極管T截

止，同時G4輸出為高電平。

2表2555定時器功能表

RdvnVi2VOT的狀

當Vii>VR,（即VH>Vcc）*

100導通

123Vcc'3Vcc0導通

當Vi2<VR2（即Vi2Me）

11VcclVCC1截止

Gi\G2輸出Q=1,Q1

3Vcc截止

113vcc1

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同進T截止，G4輸出為高電平〕1|，3V止\V。。|7變不變

這樣，就得到了表2所示555功能表。

2.應用

1）用555構(gòu)成單穩(wěn)態(tài)觸發(fā)器

其連接圖如圖23所示。

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若將其第2腳（Vi2）作為觸發(fā)器信號的輸入端，第8

腳外接電阻R是第7腳；第7腳與第1腳之間

再接一個電容C,則構(gòu)成了單穩(wěn)態(tài)觸發(fā)器。

其工作原理如下：

2

R向C充電，當Vc上升

到2Vcc時，V。為低

3

T導通，電容C放電，電路進入穩(wěn)定狀Vi

態(tài)。

+5V

i4v?

84

放電端7

Vc6

aQV0

VO

觸發(fā)輸入c

V.22

tw

15

0.01uF圖24工作波形

圖23用555定時器接成的單穩(wěn)態(tài)觸發(fā)器

1

若觸發(fā)輸入端施加觸發(fā)信號（V,1Vcc）,觸發(fā)器翻轉(zhuǎn)電路進入暫穩(wěn)態(tài)，V。輸出

為高電平，且

3

2

放電三極管T截止，此后電容C充電至Vc2,Vcc時,電

路又發(fā)生翻轉(zhuǎn)，V。為低電平，放電三極管導

通，電容c放電，電路恢復至穩(wěn)定狀態(tài)。

其工作波形如圖24所示。

R1100K

將555定時器的V-和Vi2兩個輸入端連在310K84

Vi6

30uF