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文檔簡介

（1）用與或非構(gòu)成全加器,正邏輯全加器,負(fù)邏輯全加器,（2）波形進(jìn)位,在不考慮AB的來源的情況下：,Ci延時為1.5*i,完成時間：1.5*16+1.5=25.5,Gi=Ai Bi Pi=Ai+ Bi 或 Pi=Ai Bi,（3）先行進(jìn)位,分組進(jìn)位方式,分組進(jìn)位的基本思想是根據(jù)所選器件特性要求，把加法器分成若干組每組內(nèi)采用并行進(jìn)位方式，組與組之間采用串行進(jìn)位的方式也可以采用并行進(jìn)位方式。 (A)組內(nèi)并行、組間串行的分組進(jìn)位方式 以16位并行加法器為例，將其按每組4位劃分為4個組，組內(nèi)4位按類似公式（3.6）設(shè)計如（圖3.7）所示的先行進(jìn)位電路。4個小組的進(jìn)位電路按圖(3.8)所示的關(guān)系將其串聯(lián)起來。,=1,i=A i B i C i-1 = P i C i-1,Ai Gi Bi 1.5 Pi 2.5 C4 2 C8 2 C12 2 C16 C0 2.5 C15 1.5 16,12ty完成全部,(B)組內(nèi)并行、組間并行的分組進(jìn)位方式,(4) MSI加法器模塊,（A）將8421BCD碼轉(zhuǎn)換為余3 BCD碼的代碼轉(zhuǎn)換電路.,問題：如何將余3BCD碼轉(zhuǎn)換為 8421BCD碼。,（5） 加法器的應(yīng)用舉例,設(shè) DCBA為輸入 Y4 Y3 Y2Y 1為輸出,（B） 四位二進(jìn)制加/減器,兩個運(yùn)算數(shù)分別為:,P=P4P3P2P1 Q=Q4Q3Q2Q1,控制信號為: S,關(guān)于減法電路探討,二進(jìn)制減法運(yùn)算 N補(bǔ)=2n N原 (N原為n位) N原= 2n N補(bǔ) N補(bǔ)=N反 + 1,AB = AB原 A (2n B補(bǔ)) = A+B反+1 2n (1),2. 分兩種情況討論：,注：求二進(jìn)制補(bǔ)碼為對原碼 取反加1。,(C) 利用7483(四位二進(jìn)制加法器)構(gòu)成8421BCD碼加法器.,二進(jìn)制數(shù)和8421BCD碼對照表,S=S4S3S2S1 B=B4B3B2B1,K4=C4=0 B=S,K4=C4=1 B=S+0110 無溢出,總結(jié)上表,可得:, K4=1 時,需進(jìn)行加6 (0110) 校正;,K4=1 有三種情況: a. C4=1 (對應(yīng)十進(jìn)制數(shù)16,17,18,19) ; b. S4=S3=1 (對應(yīng)十進(jìn)制數(shù)12,13,14,15) ; c. S4=S2=1(對應(yīng)十進(jìn)制數(shù)1

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