組合邏輯電路的設(shè)計(jì)實(shí)驗(yàn)報(bào)告.doc_第1頁
組合邏輯電路的設(shè)計(jì)實(shí)驗(yàn)報(bào)告.doc_第2頁
組合邏輯電路的設(shè)計(jì)實(shí)驗(yàn)報(bào)告.doc_第3頁
組合邏輯電路的設(shè)計(jì)實(shí)驗(yàn)報(bào)告.doc_第4頁
組合邏輯電路的設(shè)計(jì)實(shí)驗(yàn)報(bào)告.doc_第5頁
已閱讀5頁，還剩2頁未讀， 繼續(xù)免費(fèi)閱讀

下載本文檔

版權(quán)說明：本文檔由用戶提供并上傳，收益歸屬內(nèi)容提供方，若內(nèi)容存在侵權(quán)，請(qǐng)進(jìn)行舉報(bào)或認(rèn)領(lǐng)

文檔簡介

實(shí)驗(yàn)一組合邏輯電路的設(shè)計(jì)1. 實(shí)驗(yàn)?zāi)康?，掌握組合邏輯電路的功能分析與測(cè)試 2，學(xué)會(huì)設(shè)計(jì)以及實(shí)現(xiàn)一位全/減加器電路，以及舍入與檢測(cè)電路設(shè)計(jì)。 2. 實(shí)驗(yàn)器材74LS00 二輸入四與非門74LS04 六門反向器74LS10 三輸入三與非門74LS86 二輸入四異或門74LS73 負(fù)沿觸發(fā)JK觸發(fā)器74LS74 雙D觸發(fā)器3. 實(shí)驗(yàn)內(nèi)容1.設(shè)計(jì)舍入與檢測(cè)的邏輯電路： 1. 輸入：4位8421碼,從0000-1001 輸入信號(hào)接4個(gè)開關(guān)，從開關(guān)輸入。 2. 輸出： 當(dāng)8421碼=0101（5）時(shí)，有輸出F1=1 當(dāng)8421碼中1的個(gè)數(shù)是奇數(shù)時(shí)，有輸出F2=1,電路框圖2，設(shè)計(jì)一位全加/全減器 如圖所視：當(dāng)s=1，時(shí)做減法運(yùn)算，s=0時(shí)做加法運(yùn)算。A,B,C分別表示減數(shù)，被減數(shù)，借位（加數(shù)，被加數(shù)，進(jìn)位）4. 實(shí)驗(yàn)步驟1.設(shè)計(jì)一個(gè)舍入與檢測(cè)邏輯電路：做出真值表： 作出卡諾圖，并求出F1,F2根據(jù)F1F2的表達(dá)式做出電路圖：按照電路圖連接號(hào)電路，并且驗(yàn)證結(jié)果是否與設(shè)計(jì)相符。2,設(shè)計(jì)一位全加/全減器做出真值表：F1的卡諾圖F1卡諾圖：F2的卡諾圖按照電路圖連接號(hào)電路，并且驗(yàn)證結(jié)果是否與設(shè)計(jì)相符。5. 實(shí)驗(yàn)體會(huì)通過這次試驗(yàn)，我了解了用儀器拼接電路的基本情況。懂得了從電路圖到真實(shí)電

溫馨提示

  • 1. 本站所有資源如無特殊說明，都需要本地電腦安裝OFFICE2007和PDF閱讀器。圖紙軟件為CAD,CAXA,PROE,UG,SolidWorks等.壓縮文件請(qǐng)下載最新的WinRAR軟件解壓。
  • 2. 本站的文檔不包含任何第三方提供的附件圖紙等，如果需要附件，請(qǐng)聯(lián)系上傳者。文件的所有權(quán)益歸上傳用戶所有。
  • 3. 本站RAR壓縮包中若帶圖紙，網(wǎng)頁內(nèi)容里面會(huì)有圖紙預(yù)覽，若沒有圖紙預(yù)覽就沒有圖紙。
  • 4. 未經(jīng)權(quán)益所有人同意不得將文件中的內(nèi)容挪作商業(yè)或盈利用途。
  • 5. 人人文庫網(wǎng)僅提供信息存儲(chǔ)空間，僅對(duì)用戶上傳內(nèi)容的表現(xiàn)方式做保護(hù)處理，對(duì)用戶上傳分享的文檔內(nèi)容本身不做任何修改或編輯，并不能對(duì)任何下載內(nèi)容負(fù)責(zé)。
  • 6. 下載文件中如有侵權(quán)或不適當(dāng)內(nèi)容，請(qǐng)與我們聯(lián)系，我們立即糾正。
  • 7. 本站不保證下載資源的準(zhǔn)確性、安全性和完整性, 同時(shí)也不承擔(dān)用戶因使用這些下載資源對(duì)自己和他人造成任何形式的傷害或損失。

最新文檔

評(píng)論

0/150

提交評(píng)論