各大公司硬件工程師面試題

1、讀書破萬卷下筆如有神硬件工程師面試試題（模擬電路部分）發(fā)布時(shí)間：20XX年3月23日10時(shí)12分模擬電路1、基爾霍夫定理的內(nèi)容是什么？（仕蘭微電子）已答2、平板電容公式（C=sS/4兀kd）。（未知）已答3、最基本的如三極管曲線特性。（未知）4、描述反饋電路的概念，列舉他們的應(yīng)用。（仕蘭微電子）5、負(fù)反饋種類（電壓并聯(lián)反饋，電流串聯(lián)反饋，電壓串聯(lián)反饋和電流并聯(lián)反饋）；負(fù)反饋的優(yōu)點(diǎn)（降低放大器的增益靈敏度，改變輸入電阻和輸出電阻，改善放大器的線性和非線性失真，有效地?cái)U(kuò)展放大器的通頻帶，自動(dòng)調(diào)節(jié)作用）（未知）已答6、放大電路的頻率補(bǔ)償?shù)哪康氖鞘裁?，有哪些方法？（仕蘭微電子）7、頻率響應(yīng)，如：怎么才

2、算是穩(wěn)定的，如何改變頻響曲線的幾個(gè)方法。（未知）8、給出一個(gè)差分運(yùn)放，如何相位補(bǔ)償，并畫補(bǔ)償后的波特圖。（凹凸）9、基本放大電路種類（電壓放大器，電流放大器，互導(dǎo)放大器和互阻放大器），優(yōu)缺點(diǎn)，特別是廣泛采用差分結(jié)構(gòu)的原因。（未知）10、給出一差分電路，告訴其輸出電壓Y+和Y-,求共模分量和差模分量。（未知）11、畫差放的兩個(gè)輸入管。（凹凸）12、畫出由運(yùn)放構(gòu)成加法、減法、微分、積分運(yùn)算的電路原理圖。并畫出一個(gè)晶體管級(jí)的運(yùn)放電路。（仕蘭微電子）13、用運(yùn)算放大器組成一個(gè)10倍的放大器。（未知）14、給出一個(gè)簡(jiǎn)單電路，讓你分析輸出電壓的特性（就是個(gè)積分電路），并求輸出端某點(diǎn)的rise/fall時(shí)間

3、。（Infineon筆試試題）15、電阻R和電容C串聯(lián)，輸入電壓為R和C之間的電壓，輸出電壓分別為C上電壓和R上電壓，要求制這兩種電路輸入電壓的頻譜，判斷這兩種電路何為高通濾波器，何為低通濾波器。當(dāng)RC16、有源濾波器和無源濾波器的原理及區(qū)別？（新太硬件）17、有一時(shí)域信號(hào)S=V0sin（2pif0t）+V1cos（2pif1t）+V2sin（2pif3t+90）,當(dāng)其通過低通、帶通、高通濾波器后的信號(hào)表示方式。（未知）18、選擇電阻時(shí)要考慮什么？（東信筆試題）19、在CMOS1路中，要有一個(gè)單管作為開關(guān)管精確傳遞模擬低電平，這個(gè)單管你會(huì)用P管還是N管，為什么？（仕蘭微電子）20、給出多個(gè)mo

4、s管組成的電路求5個(gè)點(diǎn)的電壓。（Infineon筆試試題）21、電壓源、電流源是集成電路中經(jīng)常用到的模塊，請(qǐng)畫出你知道的線路結(jié)構(gòu)，簡(jiǎn)單描述其優(yōu)缺點(diǎn)。（仕蘭微電子）22、畫電流偏置的產(chǎn)生電路，并解釋。（凹凸）23、史密斯特電路，求回差電壓。（華為面試題）24、晶體振蕩器，好像是給出振蕩頻率讓你求周期（應(yīng)該是單片機(jī)的，12分之一周期.）（華為面試題）25、LC正弦波振蕩器有哪幾種三點(diǎn)式振蕩電路，分別畫出其原理圖。（仕蘭微電子）26、VCN什么，什么參數(shù)（壓控振蕩器?）（華為面試題）27、鎖相環(huán)有哪幾部分組成？（仕蘭微電子）28、鎖相環(huán)電路組成，振蕩器（比如用D觸發(fā)器如何搭）。（未知）29、求鎖相環(huán)

5、的輸出頻率，給了一個(gè)鎖相環(huán)的結(jié)構(gòu)圖。（未知）30、如果公司做高頻電子的，可能還要RF知識(shí)，調(diào)頻，鑒頻鑒相之類，不一一列舉。（未知）31、一電源和一段傳輸線相連（長(zhǎng)度為L(zhǎng),傳輸時(shí)間為T）,畫出終端處波形，考慮傳輸線無損耗。給出電源電壓波形圖，要求繪制終端波形圖。（未知）32、微波電路的匹配電阻。（未知）33、DAU口ADC的實(shí)現(xiàn)各有哪些方法？（仕蘭微電子）34、A/D電路組成、工作原理。（未知）35、實(shí)際工作所需要的一些技術(shù)知識(shí)（面試容易問到）。如電路的低功耗，穩(wěn)定，高速如何做到，調(diào)運(yùn)放，布版圖注意的地方等等，一般會(huì)針對(duì)簡(jiǎn)歷上你所寫做過的東西具體問，肯定會(huì)問得很細(xì)（所以別把什么都寫上，精通之類的

6、詞也別用太多了），這個(gè)東西各個(gè)人就不一樣了，不好說什么了。（未知）硬件工程師面試試題（數(shù)字電路部分）發(fā)布時(shí)間：20XX年3月23日10時(shí)11分?jǐn)?shù)字電路1、同步電路和異步電路的區(qū)別是什么？（仕蘭微電子）2、什么是同步邏輯和異步邏輯？（漢王筆試）同步邏輯是時(shí)鐘之間有固定的因果關(guān)系。異步邏輯是各時(shí)鐘之間沒有固定的因果關(guān)系。3、什么是線與邏輯，要實(shí)現(xiàn)它，在硬件特性上有什么具體要求？（漢王筆試）線與邏輯是兩個(gè)輸出信號(hào)相連可以實(shí)現(xiàn)與的功能。在硬件上，要用oc門來實(shí)現(xiàn)，由于不用oc門可能使灌電流過大，而燒壞邏輯門。同時(shí)在輸出端口應(yīng)加一個(gè)上拉電阻。4、什么是Setup和Holdup時(shí)間？（漢王筆試）5、set

7、up和holdup時(shí)間，區(qū)別.（南山之橋）6、解釋setuptime和holdtime的定義和在時(shí)鐘信號(hào)延遲時(shí)的變化。（未知）7、解釋setup和holdtimeviolation,畫圖說明，并說明解決辦法。（威盛VIA2003.11.06上海筆試試題）Setup/holdtime是測(cè)試芯片對(duì)輸入信號(hào)和時(shí)鐘信號(hào)之間的時(shí)間要求。建立時(shí)間是指觸發(fā)器的時(shí)鐘信號(hào)上升沿到來以前，數(shù)據(jù)穩(wěn)定不變的時(shí)間。輸入信號(hào)應(yīng)提前時(shí)鐘上升沿（如上升沿有效）T時(shí)間到達(dá)芯片，這個(gè)T就是建立時(shí)間-Setuptime.如不滿足setuptime,這個(gè)數(shù)據(jù)就不能被這一時(shí)鐘打入觸發(fā)器，只有在下一個(gè)時(shí)鐘上升沿，數(shù)據(jù)才能被打入觸發(fā)器。保

8、持時(shí)間是指觸發(fā)器的時(shí)鐘信號(hào)上升沿到來以后，數(shù)據(jù)穩(wěn)定不變的時(shí)間。如果holdtime不夠，數(shù)據(jù)同樣不能被打入觸發(fā)器。建立時(shí)間（SetupTime）和保持時(shí)間（Holdtime）。建立時(shí)間是指在時(shí)鐘邊沿前，數(shù)據(jù)信號(hào)需要保持不變的時(shí)間。保持時(shí)間是指時(shí)鐘跳變邊沿后數(shù)據(jù)信號(hào)需要保持不變的時(shí)間。如果不滿足建立和保持時(shí)間的話，那么DFF將不能正確地采樣到數(shù)據(jù)，將會(huì)出現(xiàn)metastability的情況。如果數(shù)據(jù)信號(hào)在時(shí)鐘沿觸發(fā)前后持續(xù)的時(shí)間均超過建立和保持時(shí)間，那么超過量就分別被稱為建立時(shí)間裕量和保持時(shí)間裕量。8、說說對(duì)數(shù)字邏輯中的競(jìng)爭(zhēng)和冒險(xiǎn)的理解，并舉例說明競(jìng)爭(zhēng)和冒險(xiǎn)怎樣消除。（仕蘭微電子）9、什么是競(jìng)爭(zhēng)與

9、冒險(xiǎn)現(xiàn)象？怎樣判斷？如何消除？（漢王筆試）在組合邏輯中，由于門的輸入信號(hào)通路中經(jīng)過了不同的延時(shí)，導(dǎo)致到達(dá)該門的時(shí)間不一致叫競(jìng)爭(zhēng)。產(chǎn)生毛刺叫冒險(xiǎn)。如果布爾式中有相反的信號(hào)則可能產(chǎn)生競(jìng)爭(zhēng)和冒險(xiǎn)現(xiàn)象。解決方法：一是添加布爾式的消去項(xiàng)，二是在芯片外部加電容。10、你知道那些常用邏輯電平？TTL與COMSI平可以直接互連嗎？（漢王筆試）常用邏輯電平：12V,5V,3.3V;TTL和CMO卻可以直接互連，由于TTL是在0.3-3.6V之間，而CMOS則是有在12V的有在5V的。CMOS!出接到TTL是可以直接互連。TTL接到CMO5S1要在輸出端口加一上拉電阻接到 5V或者12V。11、如何解決亞穩(wěn)態(tài)。（

10、飛利浦大唐筆試） 達(dá)到一個(gè)可確認(rèn)的狀態(tài)。當(dāng)一個(gè)觸發(fā)器進(jìn)入亞 無法預(yù)測(cè)何時(shí)輸出才能穩(wěn)定在某個(gè)正確的電平 級(jí)電平，或者可能處于振蕩狀態(tài)，并且這種無 器級(jí)聯(lián)式傳播下去。亞穩(wěn)態(tài)是指觸發(fā)器無法在某個(gè)規(guī)定時(shí)間段內(nèi) 穩(wěn)態(tài)時(shí)，既無法預(yù)測(cè)該單元的輸出電平，也 上。在這個(gè)穩(wěn)定期間，觸發(fā)器輸出一些中間 用的輸出電平可以沿信號(hào)通道上的各個(gè)觸發(fā)12、IC設(shè)計(jì)中同步復(fù)位與異步復(fù)位的區(qū)別。（南山之橋）13、MOOR百M(fèi)EELEY犬態(tài)機(jī)的特征。（南山之橋）14、多時(shí)域設(shè)計(jì)中，如何處理信號(hào)跨時(shí)域。（南山之橋）15、給了reg的setup,hold時(shí)間，求中間組合邏輯的delay范圍。（飛利浦大唐筆試）Delayq,還有cloc

11、k的delay,寫出決定最大時(shí)鐘的因素，同時(shí)給出表達(dá)式。（威盛VIA2003.11.06上海筆試試題）18、說說靜態(tài)、動(dòng)態(tài)時(shí)序模擬的優(yōu)缺點(diǎn)。（威盛VIA2003.11.06上海筆試試題）19、一個(gè)四級(jí)的Mux,其中第二級(jí)信號(hào)為關(guān)鍵信號(hào)如何改善timing。（威盛VIA2003.11.06上海筆試試題）20、給出一個(gè)門級(jí)的圖，又給了各個(gè)門的傳輸延時(shí)，問關(guān)鍵路徑是什么，還問給出輸入，使得輸出依賴于關(guān)鍵路徑。（未知）21、邏輯方面數(shù)字電路的卡諾圖化簡(jiǎn)，時(shí)序（同步異步差異），觸發(fā)器有幾種（區(qū)別，優(yōu)點(diǎn)），全加器等等。（未知）22、卡諾圖寫出邏輯表達(dá)使。（威盛VIA2003.11.06上海筆試試題）23、

12、化簡(jiǎn)F（A,B,C,D尸m（1,3,4,5,10,11,12,13,14,15）的和。（威盛）24、pleaseshowtheCMOSnverterschmaticjayoutanditscrosssectionwithP-wellprocess.Plotitstransfercurve（Vout-Vin）AndalsoexplaintheoperationregionofPMOSandNMOSforeachsegmentofthetransfercurve?（威盛筆試題circuitdesign-beijing-03.11.09）25、TodesignaCMOSnvertorwithbala

13、nceriseandfalltime,pleasedefinetherationofchannelwidthofPMOSandNMOSandexplain?26、為什么一個(gè)標(biāo)準(zhǔn)的倒相器中P管的寬長(zhǎng)比要比N管的寬長(zhǎng)比大？（仕蘭微電子）27、用mos管搭出一個(gè)二輸入與非門。（揚(yáng)智電子筆試）28、pleasedrawthetransistorlevelschematicofacmos2inputANDgateandexplainwhichinputhasfasterresponseforoutputrisingedge.（lessdelaytime）。（威盛筆試題circuitdesign-beij

14、ing-03.11.09）29、畫出NOT,NAND,NOR符號(hào)，真值表，還有transistorlevel的電路。（Infineon筆試）30、畫出CMOS勺圖，畫出tow-to-onemuxgate。（威盛VIA2003.11.06上海筆試試題）31、用一個(gè)二選一mux和一個(gè)inv實(shí)現(xiàn)異或。（飛利浦大唐筆試）32、畫出Y=A*B+C的cmos電路圖。（科廣試題）33、用邏輯們和cmos電路實(shí)現(xiàn)ab+cd。（飛利浦大唐筆試）34、畫出CMOSI路的晶體管級(jí)電路圖，實(shí)現(xiàn)Y=A*B+C（D+E）o（仕蘭微電子）35、利用4選1實(shí)現(xiàn)F（x,y,z）=xz+yz。（未知）36、給一個(gè)表達(dá)式f=xxx

15、x+xxxx+xxxxx+xxxx用最少數(shù)量的與非門實(shí)現(xiàn)（實(shí)際上就是化簡(jiǎn)）。37、給出一個(gè)簡(jiǎn)單的由多個(gè)NOT,NAND,NO由成的原理圖，根據(jù)輸入波形畫出各點(diǎn)波形。（Infineon筆試）38、為了實(shí)現(xiàn)邏輯（AXO陽）OR（CANDD）,請(qǐng)選用以下邏輯中的一種，并說明為什么？1）INV2）AND3）OR4）NAND5NOR6）XOR答案：NAND（未知）39、用與非門等設(shè)計(jì)全加法器。（華為）40、給出兩個(gè)門電路讓你分析異同。（華為）41、用簡(jiǎn)單電路實(shí)現(xiàn)，當(dāng)A為輸入時(shí)，輸出B波形為（仕蘭微電子）42、A,B,C,D,E進(jìn)行投票，多數(shù)服從少數(shù)，輸出是F（也就是如果A,B,C,D,E中1的個(gè)數(shù)比0多

16、，那么F輸出為1,否則F為0）,用與非門實(shí)現(xiàn)，輸入數(shù)目沒有限制。（未知）43、用波形表示D觸發(fā)器的功能。（揚(yáng)智電子筆試）44、用傳輸門和倒向器搭一個(gè)邊沿觸發(fā)器。（揚(yáng)智電子筆試）45、用邏輯們畫出D觸發(fā)器。（威盛VIA2003.11.06上海筆試試題）46、畫出DFF的結(jié)構(gòu)圖，用verilog實(shí)現(xiàn)之。（威盛）47、畫出一種CMOS勺D鎖存器的電路圖和版圖。（未知）48、D觸發(fā)器和D鎖存器的區(qū)別。（新太硬件面試）49、簡(jiǎn)述latch和filp-flop的異同。（未知）50、LATCHEDDFF的概念和區(qū)別。（未知）51、latch與register的區(qū)別，為什么現(xiàn)在多用register.行為級(jí)描述

17、中l(wèi)atch如何產(chǎn)生的。（南山之橋）52、用D觸發(fā)器做個(gè)二分顰的電路.又問什么是狀態(tài)圖。（華為）53、請(qǐng)畫出用D觸發(fā)器實(shí)現(xiàn)2倍分頻的邏輯電路？（漢王筆試）54、怎樣用D觸發(fā)器、與或非門組成二分頻電路？（東信筆試）55、Howmanyflip-flopcircuitsareneededtodivideby16?（Intel）16分頻？56、用filp-flop和logic-gate設(shè)計(jì)一個(gè)1位加法器，輸入carryin和current-stage,輸出carryout和next-stage.（未知）57、用D觸發(fā)器做個(gè)4進(jìn)制的計(jì)數(shù)。（華為）58、實(shí)現(xiàn)N位JohnsonCounter,N=5。（南

18、山之橋）59、用你熟悉的設(shè)計(jì)方式設(shè)計(jì)一個(gè)可預(yù)置初值的7進(jìn)制循環(huán)方t數(shù)器，15進(jìn)制的呢？（仕蘭微電子）60、數(shù)字電路設(shè)計(jì)當(dāng)然必問Verilog/VHDL,如設(shè)計(jì)計(jì)數(shù)器。（未知）61、BLOCKINGNONBLOCKING值的區(qū)另（南山之橋）62、寫異步D觸發(fā)器的verilogmodule。（揚(yáng)智電子筆試）moduledff8（clk,reset,d,q）;inputclk;inputreset;input7:0d;output7:0q;reg7:0q;always（posedgeclkorposedgereset）if（reset）q=0；elseq=d；endmodule63、用D觸發(fā)器實(shí)現(xiàn)2

19、倍分頻的Verilog描述？（漢王筆試）moduledivide2（clk,clk_o,reset）;inputclk,reset;outputclk_o;wirein;regout;always（posedgeclkorposedgereset）if（reset）out=0;elseout=in;assignin=out;assignclk_o=out;endmodule64、可編程邏輯器件在現(xiàn)代電子設(shè)計(jì)中越來越重要，請(qǐng)問：a）你所知道的可編程邏輯器件有哪些？b）試用VHD或VERILOGABLE描述8位D觸發(fā)器邏輯。（漢王筆試）PALPLD,CPLDFPGAmoduledff8（clk,r

20、eset,d,q）;inputclk;inputreset;inputd;outputq;regq;always（posedgeclkorposedgereset）if（reset）q=0;elseq=d;endmodule65、請(qǐng)用HDL描述四位的全加法器、5分頻電路。（仕蘭微電子）66、用VERILOGVHDLM一段代碼，實(shí)現(xiàn)10進(jìn)制計(jì)數(shù)器。（未知）67、用VERILOGVHDLM一段代碼，實(shí)現(xiàn)消除一個(gè)glitch。（未知）68、一個(gè)狀態(tài)機(jī)的題目用verilog實(shí)現(xiàn)（不過這個(gè)狀態(tài)機(jī)畫的實(shí)在比較差，很容易誤解的），（威盛VIA2003.11.06上海筆試試題）69、描述一個(gè)交通信號(hào)燈的設(shè)計(jì)。

21、（仕蘭微電子）70、畫狀態(tài)機(jī)，接受1,2,5分錢的賣報(bào)機(jī)，每份報(bào)紙5分錢。（揚(yáng)智電子筆試）71、設(shè)計(jì)一個(gè)自動(dòng)售貨機(jī)系統(tǒng)，賣soda水的，只能投進(jìn)三種硬幣，要正確的找回錢數(shù)。（1）畫出fsm（有限狀態(tài)機(jī)）；（2）用verilog編程，語法要符合fpga設(shè)計(jì)的要求。（未知）72、設(shè)計(jì)一個(gè)自動(dòng)飲料售賣機(jī)，飲料10分錢，硬幣有5分和10分兩種，并考慮找零：（1）畫出fsm（有限狀態(tài)機(jī)）；（2）用verilog編程，語法要符合fpga設(shè)計(jì)的要求；（3）設(shè)計(jì)工程中可使用的工具及設(shè)計(jì)大致過程。（未知）73、畫出可以檢測(cè)10010串的狀態(tài)圖，并verilog實(shí)現(xiàn)之。（威盛）74、用FSM澳現(xiàn)101101的序列

22、檢測(cè)模塊。（南山之橋）a為輸入端，b為輸出端，如果a連續(xù)輸入為1101則b輸出為1,否則為0。例如a：0001100110110100100110b:0000000000100100000000請(qǐng)畫出statemachine;請(qǐng)用RTL描述其statemachine。（未知）75、用verilog/vddl檢測(cè)stream中的特定字符串（分狀態(tài)用狀態(tài)機(jī)寫）。（飛利浦大唐筆試）76、用verilog/vhdl寫一個(gè)fifo控制器（包括空，滿，半滿信號(hào)）。（飛利浦大唐筆試）77、現(xiàn)有一用戶需要一種集成電路產(chǎn)品，要求該產(chǎn)品能夠?qū)崿F(xiàn)如下功能：y=lnx，其中，x為4位二進(jìn)制整數(shù)輸入信號(hào)。y為二進(jìn)制小數(shù)

23、輸出，要求保留兩位小數(shù)。電源電壓為35v假設(shè)公司接到該項(xiàng)目后，交由你來負(fù)責(zé)該產(chǎn)品的設(shè)計(jì)，試討論該產(chǎn)品的設(shè)計(jì)全程。（仕蘭微電子）78、sram,falshmemory,及dram的區(qū)別？（新太硬件面試）79、給出單管DRAM勺原理圖（西電版數(shù)字電子技術(shù)基礎(chǔ)作者楊頌華、馮毛官205頁圖914b）,問你有什么辦法提高refreshtime,總共有5個(gè)問題，記不起來了。（降低溫度，增大電容存儲(chǔ)容量）（Inineon筆試）80、PleasedrawschematicofacommonSRAMCellwith6transistors,pointoutwhichnodescanstoredataandwhi

24、chnodeiswordlinecontrol?（威盛筆試題circuitdesign-beijing-03.11.09）81、名詞：sram,ssram,sdram名詞IRQ,BIOS,USB,VHDL,SDRIRQ:InterruptReQuestBIOS:BasicInputOutputSystemUSB:UniversalSerialBusVHDL:VHICHardwareDescriptionLanguageSDR:SingleDataRate壓控振蕩器的英文縮寫（VCO）。動(dòng)態(tài)隨機(jī)存儲(chǔ)器的英文縮寫（DRAM）。名詞解釋，無聊的外文縮寫罷了，比如PCI、ECCDDRinterrupt

25、、pipeline、IRQ,BIOS,USB,VHDL,VLSIVCO（壓控振蕩器）RAM（動(dòng)態(tài)隨機(jī)存儲(chǔ)器），F(xiàn)IRIIRDFT（離散傅立葉變換）或者是中文的，比如：a.量化誤差b.直方圖c.白平衡硬件工程師面試試題（MCU部分）發(fā)布時(shí)間：20XX年3月23日10時(shí)10分單片機(jī)、MCU計(jì)算機(jī)原理1、簡(jiǎn)單描述一個(gè)單片機(jī)系統(tǒng)的主要組成模塊，并說明各模塊之間的數(shù)據(jù)流流向和控制流流向。簡(jiǎn)述單片機(jī)應(yīng)用系統(tǒng)的設(shè)計(jì)原則。（仕蘭微面試題目）2、畫出8031與2716（2K*8ROM的連線圖，要求采用三-八譯碼器，8031的P2.5,P2.4和P2.3參加譯碼，基本地址范圍為3000H-3FFFHt裝2716有

26、沒有重疊地址？根據(jù)是什么？若有，則寫出每片2716的重疊地址范圍。（仕蘭微面試題目）3、用8051設(shè)計(jì)一個(gè)帶一個(gè)8*16鍵盤加驅(qū)動(dòng)八個(gè)數(shù)碼管（共陽）的原理圖。（仕蘭微面試題目）4、PCI總線的含義是什么？PCI總線的主要特點(diǎn)是什么？（仕蘭微面試題目）5、中斷的概念？簡(jiǎn)述中斷的過程。（仕蘭微面試題目）6、如單片機(jī)中斷幾個(gè)/類型，編中斷程序注意什么問題；（未知）7、要用一個(gè)開環(huán)脈沖調(diào)速系統(tǒng)來控制直流電動(dòng)機(jī)的轉(zhuǎn)速，程序由8051完成。簡(jiǎn)單原理如下：由P3.4輸出脈沖的占空比來控制轉(zhuǎn)速，占空比越大，轉(zhuǎn)速越快；而占空比由K7-K0八個(gè)開關(guān)來設(shè)置，直接與P1口相連（開關(guān)撥到下方時(shí)為0”,撥到上方時(shí)為1”,

27、組成一個(gè)八位二進(jìn)制數(shù)N）,要求占空比為N/256。（仕蘭微面試題目）下面程序用計(jì)數(shù)法來實(shí)現(xiàn)這一功能，請(qǐng)將空余部分添完整。MOVP1,#0FFHLOOP1:MOVR4#0FFHMOVR3,#00HLOOP2:MOVAP1SUBBA,R3JNZSKP1SKP1:MOVC70HMOVP3.4,CACALLDELAY:此延時(shí)子程序略AJMPLOOP18、單片機(jī)上電后沒有運(yùn)轉(zhuǎn)，首先要檢查什么？（東信筆試題）9、WhatisPCChipset?（揚(yáng)智電子筆試）芯片組（Chipset）是主板的核心組成部分，按照在主板上的排列位置的不同，通常分為北橋芯片和南橋芯片。北橋芯片提供對(duì)CPU的類型和主頻、內(nèi)存的類型

28、和最大容量、ISA/PCI/AGP插槽、ECCt錯(cuò)等支持。南橋芯片則提供對(duì)KBC（鍵盤控制器）、RTC（實(shí)時(shí)時(shí)鐘控制器）、USB（通用串行總線）、UltraDMA/33（66）EIDE數(shù)據(jù)傳輸方式和ACPI（高級(jí)能源管理）等的支持。其中北橋芯片起著主導(dǎo)性的作用，也稱為主橋（HostBridge）。除了最通用的南北橋結(jié)構(gòu)外，目前芯片組正向更高級(jí)的加速集線架構(gòu)發(fā)展，Intel的8xx系列芯片組就是這類芯片組的代表，它將一些子系統(tǒng)如IDE接口、音效、MODEM!USB直接接入主芯片，能夠提供比PCI總線寬一倍的帶寬，達(dá)到了266MB/s。10、如果簡(jiǎn)歷上還說做過cpu之類，就會(huì)問到諸如cpu如何工作

29、，流水線之類的問題。（未知）11、計(jì)算機(jī)的基本組成部分及其各自的作用。（東信筆試題）12、請(qǐng)畫出微機(jī)接口電路中，典型的輸入設(shè)備與微機(jī)接口邏輯示意圖（數(shù)據(jù)接口、控制接口、所存器/緩沖器）。（漢王筆試）13、cache的主要部分什么的。（威盛VIA2003.11.06上海筆試試題）14、同步異步傳輸?shù)牟町悾ㄎ粗?5、串行通信與同步通信異同，特點(diǎn)，比較。（華為面試題）16、RS232c高電平脈沖對(duì)應(yīng)的TTL邏輯是？（負(fù)邏輯？）（華為面試題）硬件工程師面試試題（嵌入式部分）發(fā)布時(shí)間：20XX年3月23日10時(shí)9分DSP嵌入式、軟件等1、請(qǐng)用方框圖描述一個(gè)你熟悉的實(shí)用數(shù)字信號(hào)處理系統(tǒng)，并做簡(jiǎn)要的分析；

30、如果沒有，也可以自己設(shè)計(jì)一個(gè)簡(jiǎn)單的數(shù)字信號(hào)處理系統(tǒng)，并描述其功能及用途。（仕蘭微面試題目）2、數(shù)字濾波器的分類和結(jié)構(gòu)特點(diǎn)。（仕蘭微面試題目）3、IIR,FIR濾波器的異同。（新太硬件面題）4、拉氏變換與Z變換公式等類似東西，隨便翻翻書把如.h（n尸-a*h（n-1）+b*8（n）a.求h（n）的z變換；b.問該系統(tǒng)是否為穩(wěn)定系統(tǒng)；c.寫出FIR數(shù)字濾波器的差分方程；（未知）5、DSP和通用處理器在結(jié)構(gòu)上有什么不同，請(qǐng)簡(jiǎn)要畫出你熟悉的一種DSP結(jié)構(gòu)圖。（信威dsp軟件面試題）6、說說定點(diǎn)DSP和浮點(diǎn)DSP的定義（或者說出他們的區(qū)別）（信威dsp軟件面試題）7、說說你對(duì)循環(huán)尋址和位反序?qū)ぶ返睦斫?

31、（信威dsp軟件面試題）8、請(qǐng)寫出【一8,7】的二進(jìn)制補(bǔ)碼，和二進(jìn)制偏置碼。用Q15表示出0.5和一0.5.（信威dsp軟件面試題）9、DSP的結(jié)構(gòu)（哈佛結(jié)構(gòu)）；（未知）10、嵌入式處理器類型（如ARM）操作系統(tǒng)種類（Vxworks,ucos,winCE,linux）,操作系統(tǒng)方面偏CS方向了，在CS篇里面講了；（未知）11、有一個(gè)LDO芯片將用于對(duì)手機(jī)供電，需要你對(duì)他進(jìn)行評(píng)估，你將如何設(shè)計(jì)你的測(cè)試項(xiàng)目？12、某程序在一個(gè)嵌入式系統(tǒng)（200MCPU50MSDRAM中已經(jīng)最優(yōu)化了，換到零一個(gè)系統(tǒng)（300MCPU50MSDRAM中是否還需要優(yōu)化？（Intel）13、請(qǐng)簡(jiǎn)要描述HUFFMA編碼的基本

32、原理及其基本的實(shí)現(xiàn)方法。（仕蘭微面試題目）14、說出OSI七層網(wǎng)絡(luò)協(xié)議中的四層（任意四層）。（仕蘭微面試題目）15、A）（仕蘭微面試題目）#includevoidtestf（int*p）*p+=1;main（）int*n,m2;n=m;m0=1;m1=8;testf(n);printf(Datavalueis%d,*n);B）#includevoidtestf（int*p）*p+=1;main（）int*n,m2;n=m;m0=1;m1=8;testf（&n）;printf（Datavalueis%d,*n）;下面的結(jié)果是程序A還是程序B的？Datavalueis8那么另一段程序的結(jié)果是什么？16、那種排序方法最快？（華為面試題）17、寫出兩個(gè)排序算法，問哪個(gè)好？（威盛）18、編一個(gè)簡(jiǎn)單的求n!的程序。IInfineon筆試試題）19、用一種編程語言寫n!的算法。（威盛VIA2003.11.06上海筆試試題）20、用C語言寫一