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復(fù)習(xí)課概述數(shù)字電子技術(shù)電路分析基礎(chǔ)模擬電子線路微機(jī)及接口光電技術(shù)CPLDFPGA自學(xué)光電系統(tǒng)中的電控部分參加各類比賽美化生活其它。。。。數(shù)字信號(hào)數(shù)字電子系統(tǒng)邏輯門組合邏輯電路觸發(fā)器時(shí)序邏輯電路數(shù)字信息的存儲(chǔ)波形的產(chǎn)生模擬與數(shù)字的結(jié)合邏輯處理1.1數(shù)字電路與數(shù)字信號(hào)1.2數(shù)制1.3二進(jìn)制數(shù)的算術(shù)運(yùn)算1.4二進(jìn)制代碼1.5二值邏輯變量與基本邏輯運(yùn)算1.6邏輯函數(shù)及其表示方法1.數(shù)字邏輯基礎(chǔ)第一章要點(diǎn)1、區(qū)分模擬信號(hào)與數(shù)字信號(hào)2、比特率、占空比概念3、實(shí)際波形的參數(shù)4、二進(jìn)制數(shù)的表示、二-十,二-十六,等進(jìn)制的轉(zhuǎn)換5、二進(jìn)制做編碼的方法6、基本邏輯關(guān)系的含義,邏輯表達(dá)式的書寫2.邏輯代數(shù)與硬件描述語(yǔ)言基礎(chǔ)2.1
邏輯代數(shù)
2.2
邏輯函數(shù)的卡諾圖化簡(jiǎn)法
2.3
硬件描述語(yǔ)言VerilogHDL基礎(chǔ)
第二章要點(diǎn)1、邏輯代數(shù)基本公式及規(guī)則2、最小項(xiàng)、無(wú)關(guān)項(xiàng)的定義3、卡諾圖的定義、畫法、化簡(jiǎn)方法3
邏輯門電路3.1MOS邏輯門電路3.2
TTL邏輯門電路*3.3
射極耦合邏輯門電路*3.4
砷化鎵邏輯門電路3.5
邏輯描述中的幾個(gè)問題3.6
邏輯門電路使用中的幾個(gè)實(shí)際問題*3.7
用VerilogHDL描述邏輯門電路第三章要點(diǎn)1、各個(gè)系列的邏輯門的區(qū)別2、邏輯門的輸入輸出高低電平、噪聲容限、傳輸延遲時(shí)間、功耗、DP、扇出數(shù)、拉電流、灌電流等基本屬性的認(rèn)知。3、各類數(shù)字集成電路的主要性能參數(shù)(對(duì)照2點(diǎn))4、CMOS門電路的結(jié)構(gòu)特點(diǎn),OD門、三態(tài)門的、傳輸門的結(jié)構(gòu)特點(diǎn)5、TTL門電路的結(jié)構(gòu)特點(diǎn),OC門6、正負(fù)邏輯的描述7、基本邏輯門電路的符號(hào)8、CMOS和TTL門電路之間的接口問題9、門電路帶負(fù)載怎么接4組合邏輯電路4.1組合邏輯電路的分析4.2組合邏輯電路的設(shè)計(jì)4.3組合邏輯電路中的競(jìng)爭(zhēng)和冒險(xiǎn)4.4常用組合邏輯集成電路4.5組合可編程電路4.6用VerilogHDL描述組合邏輯電路第四章要點(diǎn)1、組合邏輯電路的概念2、組合邏輯電路的分析方法3、組合邏輯電路的設(shè)計(jì)方法4、組合邏輯電路中的競(jìng)爭(zhēng)冒險(xiǎn)及消除方法5、編碼器概念及相應(yīng)的IC:CD4532的使用6、譯碼器概念及相應(yīng)的IC:138、139、4511、顯示譯碼器。譯碼器的應(yīng)用:產(chǎn)生波形、產(chǎn)生函數(shù)、做數(shù)據(jù)分配7、數(shù)據(jù)選擇器及相應(yīng)的IC:151。應(yīng)用:函數(shù)的產(chǎn)生、并行數(shù)據(jù)轉(zhuǎn)換成串行數(shù)據(jù)8、數(shù)值比較器及IC:859、半加器、全加器及IC:283,超前進(jìn)位的概念10、PLD的結(jié)構(gòu)、表示方法和分類11、用PLD實(shí)現(xiàn)組合邏輯電路5鎖存器和觸發(fā)器5.1雙穩(wěn)態(tài)存儲(chǔ)單元電路5.2鎖存器5.3觸發(fā)器的電路結(jié)構(gòu)和工作原理5.4觸發(fā)器的邏輯功能第五章要點(diǎn)1、鎖存器的結(jié)構(gòu)特點(diǎn):雙穩(wěn)態(tài)的實(shí)現(xiàn)2、SR鎖存器的兩種結(jié)構(gòu)及相應(yīng)的功能及應(yīng)用:消除觸點(diǎn)開關(guān)的抖動(dòng)3、D鎖存器的兩種結(jié)構(gòu):373的使用方法4、觸發(fā)器與鎖存器的區(qū)別5、觸發(fā)器的結(jié)構(gòu)類型的區(qū)別:74的使用方法6、觸發(fā)器的動(dòng)態(tài)特性7、各種類型觸發(fā)器的邏輯功能、特性表、符號(hào)、邊沿觸發(fā)的理解。8、D觸發(fā)器轉(zhuǎn)換為其他觸發(fā)器的方法。6.
時(shí)序邏輯電路的分析與設(shè)計(jì)6.1時(shí)序邏輯電路的基本概念6.2同步時(shí)序邏輯電路的分析6.3同步時(shí)序邏輯電路的設(shè)計(jì)6.4異步時(shí)序邏輯電路的分析6.5若干典型的時(shí)序邏輯集成電路*6.6用Verilog描述時(shí)序邏輯電路6.7時(shí)序邏輯可編程邏輯器件第六章要點(diǎn)1、時(shí)序邏輯電路的基本概念及分類2、時(shí)序邏輯電路的表達(dá)方法:3、同步及異步時(shí)序邏輯電路的分析4、同步時(shí)序邏輯電路的設(shè)計(jì)5、寄存器和移位寄存器374、194的使用方法6、計(jì)數(shù)器的分類及IC:393、161的使用方法7、任意進(jìn)制的計(jì)數(shù)器的設(shè)計(jì)方法8、GAL的特點(diǎn)存儲(chǔ)器、復(fù)雜可編程邏輯器和現(xiàn)場(chǎng)可編程門陣列7.1只讀存儲(chǔ)器7.2隨機(jī)存取存儲(chǔ)器7.3復(fù)雜可編程邏輯器件*7.4現(xiàn)場(chǎng)可編程門陣列*7.5用EDA技術(shù)和可編程器件的設(shè)計(jì)例題8.1單穩(wěn)態(tài)觸發(fā)器8.2施密特觸發(fā)器8.3多器諧振蕩8.4555定時(shí)器及其應(yīng)用8脈沖波形的變換與產(chǎn)生第八章要點(diǎn)1、單穩(wěn)態(tài)觸發(fā)器的特點(diǎn)、電路組成、工作原理,中規(guī)模IC及相關(guān)的主要參數(shù)的計(jì)算。區(qū)分可重復(fù)觸發(fā)和不可重復(fù)觸發(fā)。應(yīng)用:定時(shí)、延時(shí)、消除噪聲2、施密特觸發(fā)器的特點(diǎn)、電路組成、工作原理,及相關(guān)的主要參數(shù)的計(jì)算。應(yīng)用:波形變換、整形、消除干擾信號(hào)、鑒別幅度,回差電壓的定義。3、多諧振蕩器的特點(diǎn)、電路組成、工作原理,中規(guī)模IC及相關(guān)的主要參數(shù)的計(jì)算。用門電路構(gòu)成、用施密特構(gòu)成、用石英晶體構(gòu)成、用555構(gòu)成等的方法。4、555電路的工作原理,外接元件的選擇。5、用555構(gòu)成單穩(wěn)態(tài)觸發(fā)器、施密特觸發(fā)器、多諧振蕩器的方法和元件選擇對(duì)電路參數(shù)的影響AnalogDigitalConverterandDigitalAnalogConverter9.1D/A轉(zhuǎn)換器9.2A/D轉(zhuǎn)換器。9模數(shù)與數(shù)模轉(zhuǎn)換器第九章要點(diǎn)1、D/A的基本原理和結(jié)構(gòu),各部分的實(shí)現(xiàn)2、倒T型權(quán)電阻D/A的電路結(jié)構(gòu)及原理、權(quán)電流型的改進(jìn)原因3、D/A的輸出計(jì)算4、D/A的主要技術(shù)
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