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文檔簡介
第一 第二 第一章光柱JRSG7-GZ3ALJRSG7-GZ3AL的介紹JRSG7-GZ3AL型顯示光柱電路板的電路連接關系??诮尤霐?shù)據(jù)通過CAN/485驅(qū)動轉(zhuǎn)換為正常電平然后通過光電耦合器的到FPGA,F(xiàn)PGA就會將顯示控制信號輸出,然后再經(jīng)過總線驅(qū)動到達顯示接口,驅(qū)動LED燈顯示各種圖像。圖 (U501FPG(U201ABU406JP10U205485(U101CANU102(D501U105JRSG7-GZ3AL5V+3.3V和+1.5V+5V分為兩種:經(jīng)過節(jié)能開關電路的+5V和不經(jīng)過開關電路+5VVDD表示。+3.3V1.2FPG(U201(U501(XT1(S501(Q501U205(FPGA(U201U108Q002U104U406顯示板插座(JP1-JP10)即整個顯示板都是以+5V作為電源。外部電源電 (Q001)VDD轉(zhuǎn)電 (Q002)VDD轉(zhuǎn)外部電源電 (Q001)VDD轉(zhuǎn)電 (Q002)VDD轉(zhuǎn)CANCAN485245圖 電源模塊結(jié)構245第二章JRSG7-GZ3ALJRSG7-GZ3AL型顯示光柱控制主板的基礎知識做了簡單的介紹,經(jīng)過深JRSG7-GZ3AL上電檢測時,測量CP1兩端電阻值時,阻值很?。▎纹瑱C程序無法FPGA程序無法同步總線(485)功能完全正常的顯示板511已安裝 FlashPro和單片機程FPGA程序1.111單片機程序5V.11VDD(5V電壓CP1測量電源Q001輸出是否為測量電源Q002輸出是否為一、上電檢測時,測量CP1兩端電阻值時,阻值很?。ㄐ∮?00Ω)檢查所有電容的1腳與2腳是否連焊檢查所有的5V與GND是否連焊1*10插座12腳與周圍銅皮(上層綠皮破裂)連焊例如JP10JP5等;二、單片機程序無法單片機程序器異常(在以前存在過此問題,器固件升級后沒發(fā)生;單片機供電電壓異常原因2的判斷,目視用Q001電壓轉(zhuǎn)換的三個引腳是否有虛焊,如果焊接沒問題則用萬用表分別測量三個引腳的電平如果1腳電壓約為0V,3腳電壓約5V,Q001引腳虛焊造成的。Q001原因3的判斷,查看U501的程序相關引腳是否虛焊或連焊,測量下圖所中三、FPGA程序無法FPGA程序相關引腳或晶體振蕩器XT1虛焊或連焊供電異常器異常晶振XT1是否焊反;XT1原因2的判斷,由于FPGA供電來Q001Q002,Q001的判斷已經(jīng)在“單片機程序無法”部分說明,在此不再敘述,線性電壓調(diào)節(jié)器Q002是5V轉(zhuǎn)1.5V。首先判斷Q002的三個引腳是否虛焊或連焊,如果焊接沒問題,分別測量三個引腳的電壓,10V左右,21.5V左右,35V左2。Q001原因3的判斷,如果上述兩個原因都已經(jīng)排除,那么可能是器本身問題,由于器驅(qū)動能力的不穩(wěn)定,所以會出現(xiàn)接插在一些控制主板時,F(xiàn)PGA程序無法下載,此時可以嘗試,將JTAG1的6腳(+3.3V)和7腳(VPOM)通過跳線連接在一起,然后嘗試;FPGA程序接四、上電后狀態(tài)指示狀態(tài)指示燈D501其他顏色或不亮:依次檢查D501,R501U501U501U201、XT1焊接情況、重新燒寫U201FPGA程U201、XT1焊接情況、重新燒寫U201FPGA程U201、XT1焊接情況、重新燒寫U201FPGA程U201、XT1焊接情況、重新燒寫U201FPGA程Q501、RP502及U501S501、RP502及U501如果發(fā)現(xiàn)有紅色閃爍,則需要查看FPGA程序是否成功,如果為成功,則按照“FPGA程序無法”來排查問題,如果FPGA程序已經(jīng)成功,則查看單片機FPGA通信相關引腳(FPGA(U201)引腳功能簡介)是否有虛焊或者連焊,如果發(fā)現(xiàn)藍色閃爍,按上表定位異常的器,然后查看異常器所對應的存電源部分的DC/DC(U107)電源損壞 引腳虛焊485驅(qū)動損壞光電耦合損壞;1C1075.5V原因2的判斷可按照下圖中的U101和U103的引腳焊接情況以及周圍電阻電容485原因3的判斷仍需要按照上圖中的電路連接來判斷如果確定U101和U103的電動的輸出(U101_1)和AGND1(圖中多處焊接均連接AGND1,隨便選如果4U101輸出正常,U103的輸出(U103_5)U103_4之間是否有穩(wěn)定信號,如果沒有U103已經(jīng)損壞,換一片重新焊接就行了,如果仍然有信號,那么就要判U103_5485-R之間是否有焊接問題。 電源部分DC/DC電源損壞 引腳虛焊CAN驅(qū)動損壞光電耦合損壞;1C1095.5V左右為正常。如果2U102、U104U105的引腳焊接情況以及周圍電CAN485方法將光柱檢測儀通過網(wǎng)線連接到光柱控主板然后執(zhí)行(2_0號命令)”(7和(隨化可能是網(wǎng)線接口焊接問題如果有驅(qū)動的輸(和(圖中處焊接均連接D隨便選如果示波器上有穩(wěn)定的信號顯示則說明N驅(qū)動的接收線路正??梢哉f明AN驅(qū)動是正常工作的。則可以排除此原因?qū)е峦ㄐ女惓?的判斷,CANCAN接收,然后再處理發(fā)送(CAN總線往外發(fā)送數(shù)據(jù),故無法檢測CAN驅(qū)動的輸出(U102_4)AGNDU104_3AGND之間是否有穩(wěn)定信號,如果沒有,則必然是U104_3或者U102_4虛焊,如果有,則用示波器繼續(xù)測量U104_5U104_6之間的信號,如果有規(guī)則信號,則說明光耦U104損壞,否則,說明CAN總線的接收是正常的,如果此時CAN總線通信仍然失敗,則說始測量U105的輸入U105_3和GND之間的信號,如果沒有信號則查看單片機CAN-TU105_3U105_5AGND之U105U105的輸出有信號,那么再判斷U102_1和AGND之間是否有信號,如果沒有,則仍然是這條線路七.顯示功能異口顏色控制”和“顯示總控制相關”的引腳分布、“顯示板分布及接口描述”以及“A/B列整個A列或者B列的所有LED顯示異常顯示接口JP1-JP3上接插的LED燈均顯示異常或者顯示接口JP4-JP5上接插的LED燈均顯示異?;蛘唢@示接口JP6-JP8上接插的LED燈均顯示異?;蝻@示接口JP9-JP10上接插的LED燈均顯示異常;單個顯示接口上的LED燈顯示異常LEDFPGA的接口顏色控制和顯示總控制相關引腳、顯示接口引腳,245驅(qū)動的引腳存在虛焊或者連焊而導致的。為解決這“顯示板分布及接口描述”以及“A/B列總線驅(qū)動”部分的電路連接來查找問題。Ⅰ、整個A列或者B列的所有LED顯示這類故障一般是由于“顯示總控制相關”引腳或者是245驅(qū)動虛焊U402的引腳是否虛焊或連焊;如果虛焊補焊即可,如果完成后仍然顯示異常,那么就需要在時使用示波器查看“A列顯示總控制腳”和U402的3-812-17腳查看輸出波形來判斷具體問題在哪兒,先測量“A列顯示總控制腳”的波U40212-17腳的波形,如果也正常則再次U4023-8腳的波形,確定問題的出處并解決,一般均是焊接問當整個B列顯示異常時先檢查“B列顯示總控制腳”(如下圖如果焊接正常,U405異常,那么就需要在時使用示波器查看“B列顯示總控制腳”和U405的3-8腳和12-17腳查看輸出波形來判斷具體問題在哪兒,先測量“B列顯示總控制腳”的波形,如果顯示的波形很穩(wěn)定則繼續(xù)查看U405的3-8腳的波形,如果也正常則再次查看對應的輸出腳U405的12-17腳的波形,確定問題的出處并解決,一般均是焊接Ⅱ、顯示接口JP1-JP3上接插的LED燈均顯示異常或者顯示接口JP4-JP5上接插的LED燈均顯示異?;蛘唢@示接口JP6-JP8上接插的LED燈均顯示異?;蝻@示接口JP9-JP10上接插的LED燈均顯示異常。這類故障一般都是由245驅(qū)動虛焊或者顯示接口JPn引腳連焊導致的。1、JP1-JP3LEDU4023、5、7、1315、17腳是否虛焊,如果沒有虛焊,再查看JP1、JP2、JP32、3、4、5、6引腳是否有連焊或虛焊(由于在焊接單排插座JPx時可能會過量用焊錫,導致焊錫溢出到單排插座的黑皮內(nèi)部,無法直接看到,故只能用萬用表測量JPx的兩個連續(xù)的針之間的電阻來確定,一般電阻<5Ω必定是連焊了,如果確定連焊,拆掉重焊即可)2、JP4-JP5LEDU4024、6、8、1214、16JP4、JP52、3、4、5、6引腳是否有3、JP6-JP8上接插的LEDU4053571315、17引腳是否虛焊,如果沒有虛焊,在查看JP6、JP7、JP82、3、4、5、6引腳4、JP9-JP10LEDU4054、6、8Ⅲ、單個顯示接口上的LED燈顯示245BXn示接口1作為示例,維修其他的顯示塊時,可以參考“顯示板分布及接口描述”和維修示例第二步:在顯示板分布及接口描述部分的各顯示接口使用信號名稱查詢表”中查找第一個顯示接口(P1)上的信號分布,截圖如下:第三步:在“A/B列總線驅(qū)動”的“A列245驅(qū)動及信號”部分查找上表中的6個信號所經(jīng)過的245驅(qū)動的位置及信號在對應的245引腳的分布,截圖如下:在上面兩個表中可以查到需要的信(標識為U402的表中包括CLK1STB1、BX1,引腳信號分配圖中查找此6個信號在的那個引腳上并且找到信號的源引腳,6個信號在顯示接口上的JP1顯示接口是否有連焊。方法:用萬用表測量JP1的1至9腳之間相鄰的兩個引腳的電阻,如果電阻小200ΩJP1,將兩引腳間多余的焊錫或JP1始沿這條信號線路依次往FPGA的控制引腳方向查找,當發(fā)現(xiàn)兩端信號
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