《 FPGA應(yīng)用技術(shù)及實(shí)踐 》 學(xué)習(xí)情境2++測(cè)試題_第1頁
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1學(xué)習(xí)情境二測(cè)試題（3）C.綜合可理解為，將軟件描述與給定的硬件結(jié)構(gòu)用電路網(wǎng)表文件表示的映射過4.子系統(tǒng)設(shè)計(jì)優(yōu)化，主要考慮提高資源利用率減少功耗（即面積優(yōu)化以及提①流水線設(shè)計(jì)②資源共享③關(guān)鍵路徑法④寄存器配平⑤串行化⑥邏A.①③⑤B.②③④C.②⑤⑥D(zhuǎn).①2。3A.2#1111_1110#B.8#276#C.9#170#D.15#E#E12.國(guó)際上生產(chǎn)FPGA/CPLD的主流公司，并且在國(guó)內(nèi)占有市場(chǎng)份額較大的主要是6.使用MAX+PLUSⅡ波形編輯器進(jìn)行設(shè)計(jì)輸入時(shí)，用戶不須創(chuàng)建.wdf文件。(×)9.在VHDL語法規(guī)則中，變量（VARIABLE）是一個(gè)局部變量，只能在進(jìn)程函數(shù)

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