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文檔簡介
1、EDA 原理及應(yīng)用 實驗報告題目: 交通燈控制器專業(yè):電子信息工程 班級: 姓名: 學(xué)號:設(shè)計題目:交通燈控制器二、設(shè)計目標(biāo):1、設(shè)計一個交通信號燈控制器,由一條主干道和一條支干道匯合成十字路 口,在每個入口處設(shè)置紅、綠、黃三色信號燈,紅燈亮禁止通行,綠燈亮允許通 行,黃燈亮則給行駛中的車輛有時間停在禁行線外。2、紅、綠、黃發(fā)光二極管作信號燈。3、主干道亮綠燈時,支干道亮紅燈;支干道亮綠燈時,主干道亮紅燈。4、主、支干道均有車時,兩者交替允許通行,主干道每次放行45秒,支干道每次放行25秒,設(shè)立45秒、25秒計時、顯示電路。5、在每次由綠燈亮到紅燈亮的轉(zhuǎn)換過程中,要亮 5秒黃燈作為過渡,使行
2、駛中的車輛有時間停到禁行線外,設(shè)立 5秒計時、顯示電路。三、 設(shè)計原理:(含系統(tǒng)總的原理圖)由兩個分頻器模塊,三個計數(shù)器模塊及它的選擇器,一個掃描數(shù)碼管模塊,和 一個紅綠燈控制模塊連接而成。r>r>£.if? .nlcntn;m 點4U 二clhJ工川辦ni川工MfflEtnSE7DvF:rirtFT- J.C1KRTL狀態(tài)圖四、設(shè)計內(nèi)容:(含狀態(tài)轉(zhuǎn)換圖、軟件流程圖、說明文字等,每單獨(dú)模塊的圖標(biāo)和VHDL程序;最后為總體程序框圖)分頻器1:rbvFi一 CLK FOLFT 4:iftfitiLIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;
3、USE IEEE.STD_LOGIC_UNSIGNED.ALL;ENTITY DVF ISPORT(CLK:IN STD_LOGIC;-D:IN STD_LOGIC_VECTOR(3 DOWNTO 0);FOUT:OUT STD_LOGIC);END;ARCHITECTURE one OF DVF ISSIGNAL FULL:STD_LOGIC;BEGINP_REG:PROCESS(CLK)VARIABLE CNT8:INTEGER RANGE 48000000 DOWNTO 0;BEGINIF CLK'EVENT AND CLK='1' THENIF CNT8=240
4、00000 THENCNT8:=0;FULL<='1'ELSE CNT8:=CNT8+1;FULL<='0'END IF;END IF;END PROCESS P_REG;P_DIV:PROCESS(FULL)VARIABLE CNT2:STD_LOGIC;BEGINIF FULL'EVENT AND FULL='1' THENCNT2:=NOT CNT2;IF CNT2='1' THEN FOUT<='1'ELSE FOUT<='0'END IF;END IF;EN
5、D PROCESS P_DIV;END; _L 一 , 一 一 _L T 二,一 一 . 一 一 一 一 一 一, 一 一, 田對6口電電口由電力石嚀口電電電電嚀電電可嚀口燈說明:采用的是48M時鐘輸入,作為后面的時鐘信號分頻器2DVF2CLK FOUTirstTLIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;USE IEEE.STD_LOGIC_UNSIGNED.ALL;ENTITY DVF2 ISPORT(CLK:IN STD_LOGIC;-D:IN STD_LOGIC_VECTOR(3 DOWNTO 0);FOUT:OUT STD_LOGIC);END;
6、ARCHITECTURE one OF DVF2 ISSIGNAL FULL:STD_LOGIC;BEGINP_REG:PROCESS(CLK)VARIABLE CNT8:INTEGER RANGE 48000000 DOWNTO 0; BEGINIF CLK'EVENT AND CLK='1' THENIF CNT8=20000 THENCNT8:=0;FULL<='1'ELSE CNT8:=CNT8+1;FULL<='0'END IF;END IF;END PROCESS P_REG;P_DIV:PROCESS(FULL)
7、VARIABLE CNT2:STD_LOGIC;BEGINIF FULL'EVENT AND FULL='1' THENCNT2:=NOT CNT2;IF CNT2='1' THEN FOUT<='1'ELSE FOUT<='0'END IF;END IF;END PROCESS P_DIV;END;說明:改變了分頻器的大小,這個頻率很高,是給掃描數(shù)碼管模塊使用的。計數(shù)器1.;Gntiii .,'11 'U I L ;-CLKA3.刈, CJ_Rp .OJS5. 0- URO r :單UIin.
8、gJ ':證期:二LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;USE IEEE.STD_LOGIC_UNSIGNED.ALL;ENTITY cntn ISPORT(CLK:IN STD_LOGIC;CLR:IN STD_LOGIC_vector(2 downto 0);U:IN STD_LOGIC_VECTOR(2 DOWNTO 0);A,B:OUT STD_LOGIC_VECTOR(3 DOWNTO 0);END;ARCHITECTURE bhv OF cntn ISSIGNAL J,K,L:STD_LOGIC;SIGNAL Q2,Q1:STD_
9、LOGIC_VECTOR(3 DOWNTO 0);BEGINa1:PROCESS(CLK)BEGINIF CLR="001" THEN Q1<="0100"ELSIF U="010" THENIF CLK'EVENT AND CLK='1' THENQ1<=Q1-1; IF Q1="0000" THEN Q1<="1001"J<='1'ELSE J<='0'END IF;END IF;A<=Q1;END
10、IF;END PROCESS;a2:PROCESS(J)BEGINIF CLR="001" THEN Q2<="0010"ELSIF U="010" THENIF J'EVENT AND J='1' THENQ2<=Q2-1; IF Q2="0000" THEN Q2<="0010"K<='0'ELSE K<='1'END IF;END IF;B<=Q2;END IF;END PROCESS;說明:作為支
11、干道通行時間,倒計時25s。計數(shù)器2-CLKCLRI: , 0*- UR .0CI3 .0' DI3 3 LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;USE IEEE.STD_LOGIC_UNSIGNED.ALL;ENTITY cntm ISPORT(CLK:IN STD_LOGIC;CLR:IN STD_LOGIC_vector(2 downto 0);U:IN STD_LOGIC_VECTOR(2 DOWNTO 0);C,D:OUT STD_LOGIC_VECTOR(3 DOWNTO 0);END;ARCHITECTURE bhv OF cnt
12、m ISSIGNAL J,K,L:STD_LOGIC;SIGNAL Q2,Q1:STD_LOGIC_VECTOR(3 DOWNTO 0);BEGINa1:PROCESS(CLK)BEGINIF CLR="010" THEN Q1<="0101"ELSIF U="001" THENIF CLK'EVENT AND CLK='1' THENQ1<=Q1-1; IF Q1="0000" THEN Q1<="1001"J<='1'ELSE
13、J<='0'END IF;END IF;C<=Q1;END IF;END PROCESS;a2:PROCESS(J)BEGINIF CLR="010" THEN Q2<="0000"ELSIF U="001" THENIF J'EVENT AND J='1' THENQ2<=Q2-1; IF Q2="0000" THEN Q2<="0010"K<='0'ELSE K<='1'END
14、IF;END IF;D<=Q2;END IF;END PROCESS;END ;A1姚1軻說明:要亮5秒黃燈作為過渡計數(shù)器3LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;USE IEEE.STD_LOGIC_UNSIGNED.ALL;ENTITY cntl ISPORT(CLK:IN STD_LOGIC;CLR:IN STD_LOGIC_vector(2 downto 0);U:IN STD_LOGIC_VECTOR(2 DOWNTO 0);E,F:OUT STD_LOGIC_VECTOR(3 DOWNTO 0);END;ARCHITECTURE bh
15、v OF cntl ISSIGNAL J,K,L:STD_LOGIC;SIGNAL Q2,Q1:STD_LOGIC_VECTOR(3 DOWNTO 0);BEGINa1:PROCESS(CLK)BEGINIF CLR="001" THEN Q1<="0100"ELSIF U="000" THENIF CLK'EVENT AND CLK='1' THENQ1<=Q1-1; IF Q1="0000" THEN Q1<="1001"J<='1
16、39;ELSE J<='0'END IF;END IF;E<=Q1;END IF;END PROCESS;a2:PROCESS(J)BEGINIF CLR="001" THEN Q2<="0100"ELSIF U="000" THENIF J'EVENT AND J='1' THENQ2<=Q2-1; IF Q2="0000" THEN Q2<="0010"K<='0'ELSE K<='1&
17、#39;END IF;END IF;F<=Q2;END IF;END PROCESS;END ;說明:作為主干道通行時間,倒計時45s。選擇器A(3 0UI2 0Q3,0J-Q21,DCI3期呼.朗LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;USE IEEE.STD_LOGIC_UNSIGNED.ALL;ENTITY xuanze ISPORT(U:IN STD_LOGIC_VECTOR(2 DOWNTO 0);A,B,C,D,E,F:IN STD_LOGIC_VECTOR(3 DOWNTO 0);Q1,Q2:OUT STD_LOGIC_VECTOR
18、(3 DOWNTO 0);END;ARCHITECTURE bhv OF xuanze ISBEGINPROCESS(U)BEGINcase U ISWHEN "000"=>Q1<=E;Q2<=F;WHEN "001"=>Q1<=C;Q2<=D;WHEN "010"=>Q1<=A;Q2<=B;WHEN OTHERS=>NULL;END CASE;END PROCESS;說明:不同的狀態(tài)數(shù)碼管分別顯示 45s, 25s, 5s倒計時紅綠燈控制模塊library ieee;use
19、 ieee.std_logic_1164.all;USE IEEE.STD_LOGIC_UNSIGNED.ALL;entity deng isgeneric(a:integer:=45;b:integer:=5;c:integer:=25);port(clk,rst: in std_logic;R1,G1,Y1,R2,G2,丫2 : out std_logic;U:out std_logic_vector(2 downto 0);end;architecture one of deng istype fsm_st is (QA,QB,QC,QD);signal current_state ,
20、next_state : fsm_st;SIGNAL q: integer range 0 TO 200;begin-process(clk)-begin- -if clk = '1' and clk'event then- -if q=29 then q<=0;else q<=q+1;end if;end if;- -end process;process (clk)beginif rst = '0' then current_state <= QA;q<=0;elsif clk = '1' and clk
21、9;event thencurrent_state <= next_state;if q=a+b+b+c-1 then q<=0;else q<=q+1;end if;end if;end process;process ( current_state,q)begincase current_state iswhen QA =>G1 <= '0'R2<= '0'R1<='1'Y1<='1'G2<='1'Y2<='1'U<="
22、000"if q=a-1 then next_state <= QB;else next_state <= QA;end if;when QB => Y1<='0'R2<= '0'R1<='1'G1 <= '1'G2<='1'Y2<='1'U<="001"if q=a+b-1 then next_state <= QC;else next_state <= QB;end if;when QC=>
23、; R1<='0'G2<= '0'Y1<='1'G1 <= '1'R2<='1'Y2<='1'U<="010"if q=a+b+c-1 then next_state <= QD;else next_state <= QC;end if;when QD => R1<='0'Y2<= '0'Y1<='1'G1 <= '1'G2<=
24、'1'R2<='1'U<="001"if q=a+b+b+c-1 then next_state <= QA;else next_state <= QD;end if;end case;end process;說明:設(shè)置四種狀態(tài)QAi綠,支紅;QB主黃,支紅;QCt紅,支綠;QDi紅,支黃;同時用時間控制狀態(tài)的切換掃描數(shù)碼管模塊二 Ika1J3.Oi 12I5.01利3一切一利3 . 3a&I3.OL洲拉1T3.OJ13-0Klibrary ieee;use ieee.std_logic_1164.all;us
25、e ieee.std_logic_unsigned.all;entity scan_led isport( clk:in std_logic;a1,a2,a3,a4,a5,a6,a7,a8:in std_logic_vector(3 downto 0);sg:out std_logic_vector(6 downto 0);bt:out std_logic_vector(7 downto 0);end;architecture one of scan_led issignal cnt8 : std_logic_vector(2 downto 0);signal a :std_logic_vec
26、tor(3 downto 0);beginp1:process (cnt8)begincase cnt8 iswhen "000"=>bt<=NOT"00000001"a<=a1 when "001"=>bt<=NOT"00000010"a<=a2 when "010"=>bt<=NOT"00000100"a<=a3 when "011"=>bt<=NOT"00001000&quo
27、t;a<=a4 when "100"=>bt<=NOT"00010000"a<=a5 when "101"=>bt<=NOT"00100000"a<=a6 when "110"=>bt<=NOT"01000000"a<=a7 when "111"=>bt<=NOT"10000000"a<=a8 when others=>null;end case;end
28、 process p1;p2:process(clk)beginif clk'event and clk='1' then cnt8<=cnt8+1; end if;end process p2;p3:process(a)begincase a iswhen "0000"=>sg<=NOT"0111111”;when "0001"=>sg<=NOT"0000110”;when "0010"=>sg<=NOT"1011011"when "0011"=>sg<=NOT"1001111"when "0100"=>sg<=NOT"1100110"when "0101"=>
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