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文檔簡(jiǎn)介

1、習(xí)題數(shù)字電子技術(shù)基礎(chǔ)習(xí)題第一章邏輯代數(shù)基礎(chǔ)1.1、 用布爾代數(shù)的基本公式和規(guī)則證明下列等式。1 .AB+BD+AD+DC=AB+D2 ABD+ABD+ABC=AD+ABC3 BC+D+D(B+C)(PX+5>5+D4 月8+ACD+KO+BC+BC=B+D5 AB+BC+CA-5+0)(6月)6 REC+ABC-ABTBCTCA1.AB+BC+CA=ABBCCA8 .(y十+x)(y+z)(y+為一yz(職+v)9 (義+B)(A+耳)(久十B)(A+E”0(HB+ABBC+BC)(CD+CD)-AS+BC+CD+DAW.ABCAOBOC12如果月ilEAX+BY=AXBY1.2、 求下

2、列函數(shù)的反函數(shù)。1. F1=AB+AB2. F=ABC+ABC+ABC+ABC3. =R+eD+C(其+Q)4. 嚴(yán)=B(AD+C)(C+功(0+B)5f+膠+越1.3、 寫出下列函數(shù)的對(duì)偶式?!?產(chǎn)=at耳)(才+c)(c+d的+eIF=JbSSdaBJ+B+B+C+A+C+B+C4=XYZ+XYZ1.4、證明函數(shù)F為自對(duì)偶函數(shù)。F=CQAB+AB)+C(XB+耳苗1.5、用公式將下列函數(shù)化簡(jiǎn)為最簡(jiǎn)與或”式。2 .F=(T+?)Z+J京瓶+Z期3 .=AB+AC-hBC4 .F=AB+ASC+BC5 .=AE+AC+BCAD6 .F=AB-bACD+AC+EC7 .=AC+AB+BCD+BE

3、C+DEC&嚴(yán)=415+6+1百+C)488+豆CD9F=GF+(JT+K)Z1口,尸三(萬+¥+£+甲)(,+幻(+¥+2+陰)1.6、 邏輯函數(shù)kXR+MXR+BXM斗第(五9+C)+C+X+夙m5°+C0。若A、BC、D、的輸入波形如圖所示,畫出邏輯函數(shù)F的波形。圖Tl11.7、 邏輯函數(shù)F1、F2、F3的邏輯圖如圖235所示,證明F1=F2=F3。-A-B - GD-E yET1.21.8、 給出與非“門、或非“門及異或”門邏輯符號(hào)如圖236(a)所示,若A、B的波形如圖236(b),畫出F1、F2、F3波形圖。UT1.3Cb)1.9、

4、用卡諾圖將下列函數(shù)化為最簡(jiǎn)與或”式。2,尸=5>.(012工4,6,7g9/115)工312期“3,4,5,7913/45);49=工/(23&7,810,U14);1.10、 將下列具有無關(guān)最小項(xiàng)的函數(shù)化為最簡(jiǎn)與或”式;L尸=XmY&27/3,15)21=2鵬*。35,681引3一產(chǎn)=2加"口,工工5,7石41mzm4(234,5m711/4)1.11、 用卡諾圖將下列函數(shù)化為最簡(jiǎn)與或”式;ABCAABC+ABC+ASC-2.FkRC+ABC+再G+員后守+EC二工尸=百萬+ABCD+ABC.4.FABCD+ABC+DC+DCB+ABC1.12 用卡諾圖化簡(jiǎn)下

5、列帶有約束條件的邏輯函數(shù)1F1(A,B,C,D)=2>486圈9兒12)十二/012,1算4»)2P父氏BCD)-2辟地工3,4*11簿)+印加,用4,心)圖TL41.13 、用最少的與非”門畫出下列多輸出邏輯函數(shù)的邏輯圖。1 .fF=AC+BC-hAC-G=ASBCAB尸=7>*(2340,11,15)2 G=+(0P2,W0;l,15)、N=2>42,4,6,1(MU5)第二章門電路2.1 由TTL門組成的電路如圖T2.1所示,已知它們的輸入短路電流為Iis=1.6aA,高電平輸入漏電流IiH=40仙A。試問:當(dāng)A=B=1時(shí),G1的.電流(拉,灌)為;A=0時(shí),

6、G1的電流(拉,灌)為.。圖T21圖T2.2中示出了某門電路的特性曲線,試據(jù)此確定它的下列參數(shù):輸出高電平UOH=;輸出低電平UOL=;輸入短路電流Iis=;高電平輸入漏電流IiH=;閾值電平Ut=;開門電平UON=;關(guān)門電平UOFF=;低電平噪聲容限UNL=;高電平噪聲容限UNH=;最大灌電流IOLMax=;扇出系數(shù)N=。圖T>22.3 TTL門電路輸入端懸空時(shí),應(yīng)視為(高電平,低電平,不定)此時(shí)如用萬用表測(cè)量其電壓,讀數(shù)約為(3.5V , 0V , 1.4V )2.4 CT74、CT74H、CT74S、CT74LS四個(gè)系歹用勺TTL集成電路,其中功耗最小的為;速度最快的為;綜合性能指

7、標(biāo)最好的為2.5 CMOS門電路的特點(diǎn):靜態(tài)功耗(很大,極低);而動(dòng)態(tài)功耗隨著工作頻率的提高而-(增加,減小,不變);輸入電阻(很大,很?。?;噪聲容限.(高,低,等)于TTL門。之間接一電阻(輸出與地,2.6 集電極開路門(OC門)在使用時(shí)須在輸出與輸入,輸出與電源)。2.7 圖2.3所示電路中,G1、G2、G3是74LS系列的OC門,輸出高電平時(shí)漏電流Icex=100仙A,其輸出電流ILOmax=8mA;G4、G5、G6是74LS系列的與非門,其輸入電流IiL=400祖A,IiH=20aA。試計(jì)算電阻RL的取值范圍。+5VUT2.32.8 圖T2.4中G1為TTL三態(tài)門,G2為TTL與非門,

8、萬用表的內(nèi)阻20kQ/V,量程5V。當(dāng)C=1或C=0以及S通或斷等不同情況下,U01和U02的電位各是多少?請(qǐng)?zhí)钊氡碇?,如果G2的懸空的輸入端改接至0.3V,上述結(jié)果將有何變化?圖T24CS通5新1U口 1=Uql1Uci尸Ug=0U口 Lu尸0Uo尸Ug=圖T252.9 圖T2.5示電路為TTL門電路,若用高內(nèi)阻電壓表各圖M點(diǎn)的電壓,估算一下量測(cè)出M點(diǎn)的電壓為多少伏,并說明理由。2.10 圖T2.6示電路為TTL門電路,非門的輸入短路電流移,高電平輸入電流為-0-05,當(dāng)門1輸入A為“1”或“0”時(shí),問各流入門1輸出端的電流為多少毫安?2.11 某同學(xué)按照上圖線路做實(shí)驗(yàn)時(shí),當(dāng)A="

9、1”時(shí),M點(diǎn)的電壓Vm=1.6V左右,試分析原因。2.12 圖T2.7所示電路為TTL三態(tài)門。三態(tài)門控制端G和波形如圖所示,試分析此電路能否正常工作,2.13 圖T2.8為由TTL“與非”門組成的電路,輸入A、B的波形如圖所示,試畫出V0的波形。aIrMJpikF011rn-F-UJL圖T2s2.14 圖T2.9中門1、2、3均為TTL門電路,平均延遲時(shí)間為20ns,畫出VO的波形。出VbV(j ; : ; iflns40nn 60ns4()ris4(ta3 40cls 里愀£A1 Q-ajnk圖T2.9第三章組合數(shù)字電路習(xí)題:3.1 分析圖圖T3.1所示電路的邏輯功能,寫出輸出的邏

10、輯表達(dá)式,列出真值表,說明其邏輯功能。圖T313.2 邏輯電路如圖T3.2所示:1、寫出S、C、P、L的函數(shù)表達(dá)式;2、當(dāng)取S和C作為電路的輸出時(shí),此電路的邏輯功能是什么?圖T323.3 圖T3.3為由三個(gè)全加器構(gòu)成的電路試寫出其輸出F1,F2,F3,F4的表達(dá)式。圖T333.4 圖T3.4為由集成四位全加器74LS283和或非門構(gòu)成的電路,已知輸入DCBA為BCD8421碼,寫出B2B1的表達(dá)式,并列表說明輸出D'C'B'A'為何種編碼?3.5 圖T3.5是由3線/8線譯碼器74LS138和與非門構(gòu)成的電路,試寫出P1和P2的表達(dá)式,列出真值表,說明其邏輯功能

11、。74LS13SEN01234567圖T353.6 圖T3.6是由八選一數(shù)據(jù)選擇器構(gòu)成的電路,試寫出當(dāng)G1G0為各種不同的取值時(shí)的輸出Y的表達(dá)式。GtGO A一1B圖T363.7 某水倉(cāng)裝有大小兩臺(tái)水泵排水,如圖T3.7所示。試設(shè)計(jì)一個(gè)水泵啟動(dòng)、停止邏輯控制電路。具體要求是當(dāng)水位在H以上時(shí),大小水泵同時(shí)開動(dòng);水位在H、M之間時(shí),只開大泵;水位在M、L之間時(shí),只開小泵;水位在L以下時(shí),停止排水。(列出真值表,寫出與或非型表達(dá)式,用與或非門實(shí)現(xiàn),注意約束項(xiàng)的使用)3.8 仿照全加器設(shè)計(jì)一個(gè)全減器,被減數(shù)A,減數(shù)B,低位來的借位J0,差為D,向上一位的借位為J。要求:1、列出真值表,寫出D、J的表達(dá)

12、式;2、仿全加器,用二輸入與非門實(shí)現(xiàn);3、用最小項(xiàng)譯碼器74LS138實(shí)現(xiàn);4、用雙四選一數(shù)據(jù)選擇器實(shí)現(xiàn)。3.9 設(shè)計(jì)一組合數(shù)字電路,輸入為四位二進(jìn)制碼B3B2B1B0,當(dāng)B3B2B1B0是BCD8421碼時(shí)輸出Y=1;否則Y=0。列出真值表,寫出與或非型表達(dá)式,用集電極開路門實(shí)現(xiàn)。3.10 設(shè)計(jì)一顯示譯碼器,輸入三個(gè)變量,輸出控制共陽極數(shù)碼管顯示六個(gè)字形,字形從0-9及A-Z中任選,要求用與非門實(shí)現(xiàn)。3.11 試用最小項(xiàng)譯碼器74LS138和和一片74LS00實(shí)現(xiàn)邏輯函數(shù):上尸£爾P式41尸2;碑02司3.12 試用四位全加器74LS283和二輸入與非門實(shí)現(xiàn)BCD8421碼到BCD

13、5421碼的轉(zhuǎn)換。3.13 設(shè)計(jì)一個(gè)8421碼轉(zhuǎn)換成格雷碼的轉(zhuǎn)換電路。列出表達(dá)式,用“異或”門實(shí)現(xiàn)之。3.14 設(shè)計(jì)一個(gè)多功能組合數(shù)字電路,實(shí)現(xiàn)下表所示邏輯功能。表中C1,C0為功能選擇輸入信號(hào);A,B為輸入變量;F為輸出。1、列出真值表,寫出F的表達(dá)式;2、用八選一數(shù)據(jù)選擇器和門電路實(shí)現(xiàn)ABAB3.15 用8選1數(shù)據(jù)選擇器實(shí)現(xiàn)下列函數(shù):(1)9=匯芨+(應(yīng)+花十無'F/,XYZ+XZW+a+XY=XYZ+IF+Zf產(chǎn)=2>'8,1,2二&9,1。11)F=ABCD+ABCD+ABCD+ABCD+ABCD+ABCD+ABCD+ABCD3.16 分析圖3.8(a)所

14、示電路,寫出L,Q,G的表達(dá)式,列出真值表,說明它完成什么邏輯功能;用圖3.8(a)所示電路與集成四位數(shù)碼比較器(如圖3.17 b)所示)構(gòu)成一個(gè)五位數(shù)碼比較器。PA>0巳=日A>B74LS85A=EA<E正E3A2日2AlB1AOB。圖T3.«3.17 要實(shí)現(xiàn)邏輯函數(shù)p-dm+Rc十豆e,能否只使用一片集成電路,是什么型號(hào),如何連線?3.18 分析圖T3.9所示電路中,當(dāng)A、B、C、D只有一個(gè)改變狀態(tài)時(shí),是否存在競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象?如果存在,都發(fā)生在其他變量為何種取值的情況下?圖T3.9第四章觸發(fā)器和定時(shí)器4.1 圖T4.1(a)是由與非門構(gòu)成的基本R-S觸發(fā)器,試畫出

15、在圖(b)所示輸入信號(hào)的作用下的輸出波形。Q::圖T414.2 分析圖T4.2所示電路,列出特性表,寫出特性方程,說明其邏輯功能4.3 由CMOS門構(gòu)成的電路如圖T4.3(a)所示,請(qǐng)回答:(1)C=0時(shí)該電路屬于組合電路還是時(shí)序電路?C=1時(shí)呢?(2)分別寫出輸出Q(或b1)的表達(dá)式;(3)已知輸入A,B,C的波形如圖T4.3(b),請(qǐng)畫出對(duì)應(yīng)的輸出Q的波形。4.4 已知CP和D的波形如圖T4.4所示,試對(duì)應(yīng)畫出習(xí)題4.2中電路的輸出Q1及維持阻塞型D觸發(fā)器的輸出Q2的波形。(Q1Q2的初始狀態(tài)為圖T444.5 請(qǐng)用一個(gè)與門和一個(gè)D觸發(fā)器構(gòu)成一個(gè)T觸發(fā)器。4.6 試寫出圖T4.5(a)中各T

16、TL觸發(fā)器輸出的次態(tài)函數(shù)(十”),并畫出在圖(b)所示CP波形作用下的輸出波形。(各觸發(fā)器的初態(tài)均為“0”)(b)圖T45所示,觸發(fā)器為維持阻塞型D觸發(fā)器,初態(tài)均4.7 時(shí)序邏輯電路如圖T4.6(a)為“0”(1)畫出在圖(b)所示CP作用下的輸出QiQ2和Z的波形;分析Z與CP的關(guān)系qx:i: !Q2:i::tIiIdihbb z :;:;(a)圖T464.8 根據(jù)特性方程,外加與非門將D觸發(fā)器轉(zhuǎn)換為J-K觸發(fā)器;若反過來將J-K觸發(fā)器轉(zhuǎn)換為D觸發(fā)器,當(dāng)如何實(shí)現(xiàn)?:::h;L日;:; ;H :Ji: *(Mrn-njwTW-TL, dI-fIri *-f!. h|414.9 已知電路及CPA

17、的波形如圖T4.7(a)和(b)所示,設(shè)觸發(fā)器的初態(tài)為“0”,試畫出輸出端B和C的波形。圖T4)4.10 試畫出圖T4.8(a)所示電路在圖(b)所示輸入信號(hào)CPX作用下的輸出Q1、Q2和Z的波形(Q1、Q2的初態(tài)為“0”)。圖T4Wcp_rL_TL_RLx J :UU : :U:ULQ1_ :Q2_ :Z:(b)4.11 圖T4.9(a)為由555定時(shí)器和D觸發(fā)器構(gòu)成的電路,請(qǐng)問:555定時(shí)器構(gòu)成的是那種脈沖電路?(2)在圖(b)中畫出Uc,U01,U02的波形;計(jì)算U01和U02的頻率。(4)如果在555定時(shí)器的第5腳接入4V的電壓源,則U01的頻率將變?yōu)槎嗌??UcA+5V(QCb)因T4

18、34.12 圖T4.10(a)是由555定時(shí)器構(gòu)成的單穩(wěn)態(tài)觸發(fā)電路。(1)簡(jiǎn)要說明其工作原理;(2)計(jì)算暫穩(wěn)態(tài)維持時(shí)間tw(3)畫出在圖(b)所示輸入ui作用下的uC和u。的波形。(4)若ui的低電平維持時(shí)間為15ms,要求暫穩(wěn)態(tài)維持時(shí)間tw不變,應(yīng)采取什么措施?R9 IkIT-O.lpFa)Uc+t(ms)Uq,t(ms)CbJUT4.104.13 由555定時(shí)器構(gòu)成的施密特觸發(fā)器如圖T4.11(a)所示(1)在圖(b)中畫出該電路的電壓傳輸特性曲線;(2)如果輸入ui為圖(c)的波形;所示信號(hào),對(duì)應(yīng)畫出輸出uO的波形;(3)為使電路能識(shí)別出ui中的第二個(gè)尖峰,應(yīng)采取什么措施?(4)在555

19、定時(shí)器的哪個(gè)管腳能得到與3腳一樣的信號(hào),如何接法?(b)E1T4114.14 圖4.12為由兩個(gè)555定時(shí)器接成的延時(shí)報(bào)警器,當(dāng)開關(guān)S斷開后,經(jīng)過一定的延遲時(shí)間td后揚(yáng)聲器開始發(fā)出聲音,如果在遲延時(shí)間內(nèi)閉合開關(guān),揚(yáng)聲器停止發(fā)聲。在圖中給定的參數(shù)下,計(jì)算延遲時(shí)間td和揚(yáng)聲器發(fā)出聲音的頻率。圖T4.12第五章時(shí)序數(shù)字電路5.1 分析圖T5.1所示時(shí)序電路,作出它的狀態(tài)表和狀態(tài)圖。作出電平輸入X序列為1011100時(shí)電路的時(shí)序圖。T51CPX5.2 分析圖T5.2所示時(shí)序電路,作出它的狀態(tài)表和狀態(tài)圖并作當(dāng)X1=1111110及X2=0110110時(shí)的時(shí)序圖(設(shè)觸發(fā)器初態(tài)為“00”)。5.3分析圖T5

20、.3Y 0=000 。所示時(shí)序電路,作出它的狀態(tài)圖和時(shí)序圖。起始狀態(tài)CP5.4畫出圖T5.4 =0001 。所示時(shí)序電路的狀態(tài)圖和時(shí)序圖,起始狀態(tài)為Y3Y2Y1Y0Y3¥2Y1¥c5.5 畫出圖5.5圖所示同步十進(jìn)制減法計(jì)數(shù)器的狀態(tài)圖和時(shí)序圖5.6 圖T5.6所示電路是為某接收機(jī)而設(shè)計(jì)白分頻電路,初始狀態(tài)為“00”,問:(1)當(dāng)X1X2=“00”;(2)當(dāng)X1X2=“01”;(3)當(dāng)X1X2=“11”時(shí),各種狀態(tài)為幾分頻?畫出波形圖。5.7 同步4位二進(jìn)制計(jì)數(shù)器的功能表及邏輯符號(hào)如圖T5.7(a)所示。如果同步二進(jìn)制計(jì)數(shù)器按圖T5.7(b)所示電路連接,要求:(1)列出該計(jì)

21、數(shù)器的計(jì)數(shù)順序Qd端輸出是幾分頻、占空比是多少?r I I 1 I 1,L QaQsQcQ 口-CK一'Rd ABC t> T -圖 T5.7Q aQbQc Qd L * i"5.8 指出下列各種觸發(fā)器中,哪些能組成移位寄存器,哪些不能;如果能,在()內(nèi)打?qū)μ?hào),否則打X?;綬-S觸發(fā)器();(2)同步R-S觸發(fā)器();主從J-K觸發(fā)器();(4)維持阻塞D觸發(fā)器();(5)邊沿J-K觸發(fā)器();(6)CMOS主從D觸發(fā)器()。5.9 用維持阻塞D觸發(fā)器和與非門設(shè)計(jì)一個(gè)三位右移寄存器,用一控制端X控制,當(dāng)X=0時(shí)能串行輸入新數(shù)據(jù)DI,當(dāng)X=1時(shí)具有自循環(huán)功能。5.10

22、按照規(guī)定的狀態(tài)分配,分別寫出采用D觸發(fā)器、JK觸發(fā)器來實(shí)現(xiàn)狀態(tài)表5.1所示的時(shí)序邏輯電路。表工1g1COAD/001hCfo10co/a6州11D5.11 用負(fù)邊沿JK觸發(fā)器及2輸入4輸出變量譯碼器,設(shè)計(jì)一個(gè)4相時(shí)鐘分配器。5.12 用JK觸發(fā)器設(shè)計(jì)一個(gè)可控計(jì)數(shù)器,當(dāng)控制端C=1時(shí),實(shí)現(xiàn)000100一110-111011000;當(dāng)C=0時(shí),實(shí)現(xiàn)000100110010一011000計(jì)數(shù)。要求寫出:(1)狀態(tài)圖;(2)狀態(tài)表;(3)狀態(tài)方程;(4)檢查能否自啟動(dòng),畫出狀態(tài)圖;(5)畫出邏輯圖。5.13 用JK觸發(fā)器設(shè)計(jì)“1011”序列檢測(cè)器。要求寫出:(1)狀態(tài)圖;(2)狀態(tài)表;(3)三種獨(dú)立的

23、狀態(tài)分配方案;(4)分別寫出三種分配方案的狀態(tài)方程;(5)畫出最佳設(shè)計(jì)的邏輯圖。5.14 用正邊沿D觸發(fā)器及其他門電路,設(shè)計(jì)一個(gè)節(jié)拍發(fā)生器,節(jié)拍順序如圖T5.8所示,寫出設(shè)計(jì)過程。ET5.85.15用正邊沿DCP、X為輸入,型觸發(fā)器設(shè)計(jì)一個(gè)滿足圖T5.9所示波形要求的邏輯電路,5.16 用正邊沿D觸發(fā)器設(shè)計(jì)一個(gè)具有如下功能的電路(電路如圖T5.10所示)。(1)開關(guān)K處于位置1(即X=0)時(shí),輸出ZW=00;(2)當(dāng)開關(guān)K擲到2(即X=1)時(shí),電路要產(chǎn)生完整的系列輸出,即ZW:00-01-11一10(開始X在位置1);(3)如果完整的系列輸出后,K仍在位置2,則ZW一直保持10狀態(tài),只有當(dāng)K回

24、到位置1時(shí),ZW才重新回到00。要求:(1)畫出最簡(jiǎn)狀態(tài)圖;(2)列出狀態(tài)表;(3)給定狀態(tài)分配;(4)寫出狀態(tài)方程及輸出方程;(5)畫出邏輯圖。+5V圖T”。設(shè)討 的 電路5.17 分析圖T5.11所示由74LS161構(gòu)成的電路(1)畫出完整的狀態(tài)轉(zhuǎn)換圖;(2)畫出Qd相對(duì)于CP的波形,說明是幾分頻,Qd的占空比是多少pT74LS1S1C廠CDcBAL口DT5.115.18 分析圖T5.12中的電路,說明它們分別是多少進(jìn)制計(jì)數(shù)器?并回答:(1)若將圖(a)中與非門G的輸出改接至Cr端,而令Ld=1,畫出狀態(tài)轉(zhuǎn)換轉(zhuǎn)圖,電路變?yōu)閹走M(jìn)制?(2)圖(b)電路的輸出采用的是何種編碼?列出狀態(tài)轉(zhuǎn)換表。&

25、quot;1pQc Qfc -T 74LS16Cr d c B A LdP74LS16"1C B A(a)(b)PQb /74LS16 比Cr D C B A Ld(C)5.19試用兩片74LS161組成模為90 并工作可靠。的計(jì)數(shù)器,要求兩片間采用異步審級(jí)法,5.20 圖T5.13為由集成異步計(jì)數(shù)器74LS90、74LS93構(gòu)成的電路,試分別列出狀態(tài)轉(zhuǎn)換表,說明它們是多少進(jìn)制的計(jì)數(shù)器。CF-WPb一TCPa圖5135.21 分析圖T5.14所示電路的工作過程1、畫出對(duì)應(yīng)CP的輸出QaQdQc和Qb的波形和狀態(tài)轉(zhuǎn)換圖(Qa為高位)2、按QaQdQcQb順序電路給出的是什么編碼?3、按

26、QdQcQbQa順序電路給出的編碼又是什么樣的?,I,CP加句,74LSS0即理IjI1圖T5145.22圖T5.15所示為一可變進(jìn)制計(jì)數(shù)器。其中74LS138為3線/8線譯碼器,當(dāng)Si=1且瑪=0二°時(shí),它進(jìn)行譯碼操作,即當(dāng)A2A1A0從000到111變化時(shí)匕£依次被選中而輸出低電平。T1153為四選一數(shù)據(jù)選擇器。試問當(dāng)MN為各種不同輸入時(shí),可組成幾種不同進(jìn)制的計(jì)數(shù)器?分別是幾進(jìn)制?簡(jiǎn)述理由。圖T515第六章大規(guī)模集成電路6.1 填空:1、按構(gòu)成材料的不同,存儲(chǔ)器可分為磁芯和半導(dǎo)體存儲(chǔ)器兩種。磁芯存儲(chǔ)器利用來存儲(chǔ)數(shù)據(jù);而半導(dǎo)體存儲(chǔ)器利用來存儲(chǔ)數(shù)據(jù)。兩者相比,前者一般容量較

27、;而后者具有速度的特點(diǎn)。2、半導(dǎo)體存儲(chǔ)器按功能分有和兩種。3、ROM主要由和兩部分組成。按照工作方式的不同進(jìn)行分類,ROM可分為、和三種。4、某EPROMt8數(shù)據(jù)線,13位地址線,則其存儲(chǔ)容量為。5、在系統(tǒng)可編程邏輯器件簡(jiǎn)稱為器件,這種器件在系統(tǒng)工作時(shí)(可以、不可以)對(duì)器件的內(nèi)容進(jìn)行重構(gòu),它包括、三種系列的產(chǎn)品。6、對(duì)isp器件進(jìn)行編程時(shí)(需要、不需要)專門的編程器,對(duì)GAL器件進(jìn)行編程時(shí)(需要、不需要)專門的編程器。7、對(duì)GAL器件和ispLSI器件進(jìn)行編程時(shí)可以選用下列那幾種輸入方式。a)原理圖方式b)ABEL-HDL語言c)VHDL語言d)原理圖與ABEL語言混合輸入方式e)FM輸入方式

28、6.2 圖T6.1是16X4位ROM,A3A2A1A0為地址輸入,D3D2D1D0為數(shù)據(jù)輸出,試分別寫出D3,D2,D1和D0的邏輯表達(dá)式。A3A2A1AOD3 D2 D1 DO地址逢碼器國(guó)T6I6.3 用16X4位ROM作成兩個(gè)兩位二進(jìn)制數(shù)相乘(A1A0XB1B0)的運(yùn)算器,列出真值表,畫出存儲(chǔ)矩陣的結(jié)點(diǎn)圖。6.4 由一個(gè)三位二進(jìn)制加法計(jì)數(shù)器和一個(gè)ROM構(gòu)成的電路如圖T6.2(a)所示1、寫出輸出F1、F2和F3的表達(dá)式;2、畫出CP作用下F1、F2和F3的波形(計(jì)數(shù)器的初態(tài)為“0圖T6,2計(jì) 般 器地址譯碼器cpnjTTLrWLTLrLF1:iI:;F2:;:;:F3:6.5 用PLA的與

29、或ROM對(duì)實(shí)現(xiàn)全加器6.6 用ispLSI器件實(shí)現(xiàn)一個(gè)用于步進(jìn)電機(jī)驅(qū)動(dòng)電路的序列脈沖發(fā)生器,步進(jìn)電機(jī)有ABCDE五相繞組,工作時(shí)的導(dǎo)通順序?yàn)锳B-ABCBCBCDCDCDEDE-DEAEAEABAB。(用五個(gè)D觸發(fā)器實(shí)現(xiàn))。要求:1列出狀態(tài)轉(zhuǎn)換表,寫出狀態(tài)方程,2用ABEL-HDL或VHDL語言編寫程序。6.7 試分析圖T7.3所示電路的工作原理,畫出輸出電壓Uo的波形。(表6.1中列出的是2716的十六個(gè)地位地址單元中所存的數(shù)據(jù)))GJP GM0' 5 5 5 6 % Dl D. 271表61Aj AMiAjPj Dj Di P)CS6迪匡公用倒徨因00 0 0O-0 0 100 1000 11010 0010 10110011110 0 010 0 110 1010 11110 000000 0001111000000"1_L2_|p Qd QcQaOt74LS16CLCr。C 卜 A 9/ “ I I I I I IffiT6.3OOQOOOOOOOOOO

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