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1、基于基于VHDL的的交通交通信號(hào)燈控制信號(hào)燈控制系統(tǒng)的系統(tǒng)的設(shè)計(jì)設(shè)計(jì)姓名:陳麗婷 學(xué)號(hào):1108431119 班級(jí):通信工程一班 指導(dǎo)教師:趙曉虎意義意義:近些年來(lái),由于汽車(chē)數(shù)量的增加,我國(guó)許多大中型城市的交通,帶來(lái)了嚴(yán)峻的考驗(yàn),也導(dǎo)致了交通問(wèn)題日漸嚴(yán)重。日常生活中的交通堵塞成為人們常見(jiàn)而又不得不容忍的問(wèn)題。在這種交通背景下,開(kāi)發(fā)出適合我們自己的交通信號(hào)燈控制系統(tǒng)是非常重要的??刂葡到y(tǒng)框圖:控制系統(tǒng)框圖:時(shí)鐘時(shí)鐘分頻分頻模塊模塊仿真波形:電路符號(hào):ret在低電平有效,Clk設(shè)置為50M,從仿真圖中可以看出該模塊完成了分頻功能。時(shí)鐘發(fā)生電路最主要的功能就是產(chǎn)生一些穩(wěn)定的輸出信號(hào),可以為后面的電路
2、提供同步的信號(hào)??刂朴?jì)時(shí)模塊控制模塊的電路符號(hào):控制模塊是系統(tǒng)的重要模塊,用于控制交通燈的工作狀態(tài)和計(jì)時(shí)時(shí)間??刂朴?jì)時(shí)模塊仿真圖:顯示模塊顯示模塊可根據(jù)控制模塊的輸出信號(hào)和時(shí)鐘脈沖來(lái)實(shí)現(xiàn)倒計(jì)時(shí)數(shù)碼管的顯示。 顯示模塊仿真圖:顯示模塊仿真圖:顯示模塊電路符號(hào)顯示模塊電路符號(hào)頂層文件將以上各個(gè)模塊軟件仿真成功之后,再編寫(xiě)頂層文件,然后將各個(gè)單元模塊連接,統(tǒng)一起來(lái),統(tǒng)一調(diào)配,就可以得到頂層文件的原理圖。E2C3B1Q2S8550Q3S8550Q4S8550Q5S8550VCCR19470R20470R21470R22470VCC123J2CON3123J1CON3R4470R5470R6470R74
3、70R8470R9470R10470A3B9C8D6E7F4G1DP2S210S15U1LED-2P20P21P22P23P24P25P26SEL0SEL1A3B9C8D6E7F4G1DP2S210S15U2LED-2P20P21P22P23P24P25P26SEL6SEL7A3B9C8D6E7F4G1DP2S210S15U3LED-2P20P21P22P23P24P25P26SEL4SEL5A3B9C8D6E7F4G1DP2S210S15U4LED-2P20P21P22P23P24P25P26SEL2SEL301234567Q6S8550Q7S8550Q8S8550Q1S8550R15470
4、R16470R17470R18470S0P26P25P24P23P22P21P2001234567SEL0SEL1SEL2SEL3SEL4SEL5SEL6SEL7S1S2S3S4S5S6S7S0S1S2S3S4S5S6S71A2KD4紅1A2KD5綠1A2KD6黃VCCR11470R1275R13470P10P11P121A2KD7紅1A2KD8綠1A2KD9黃VCC1A2KD10紅1A2KD11綠1A2KD12黃VCC1A2KD1紅1A2KD2綠VCCR1470R275R3470P13P14P15KEY11A2KD3黃S1SW-PBR144.7KVCCLED0LED1LED2LED3LED4
5、LED5LED0LED1LED2LED3LED4南北禁行123456789101112131415J41234567J3CON7P10P11P12P13P14P15KEY1位選段碼紅綠黃燈硬件設(shè)計(jì)原理圖:硬件設(shè)計(jì)原理圖:根據(jù)硬件設(shè)計(jì)原理圖管腳連接,進(jìn)行實(shí)物的搭建和連接。適配下載適配下載進(jìn)行實(shí)物連接好后,要把設(shè)計(jì)好的軟件程序進(jìn)行適配下載。所設(shè)計(jì)的交通燈控制器通過(guò)Quartus II 9.0軟件完成了編程仿真測(cè)試,并達(dá)到了設(shè)計(jì)要求后,要將編譯的程序下載到含目標(biāo)芯片F(xiàn)PGA的開(kāi)發(fā)板上,完成實(shí)際的檢驗(yàn)。本次的畢業(yè)設(shè)計(jì),采用FPGA作為目標(biāo)芯片,輸入的是時(shí)鐘分頻模塊,輸出的是數(shù)碼管顯示控制模塊。按照硬件設(shè)計(jì)原理圖,把交通燈板子和FPGA板子連接好,然后進(jìn)行整個(gè)設(shè)計(jì)系統(tǒng)的編譯,從而完成對(duì)目標(biāo)芯片的適配下載。硬件調(diào)試:硬件調(diào)試:采用的FPGA芯片編程下載成功后,將時(shí)鐘源Clock0經(jīng)跳線帽與1Hz脈沖短路,即輸入秒脈沖。系統(tǒng)復(fù)位鍵置低電平,則系統(tǒng)開(kāi)始工作,即首先南北向點(diǎn)亮綠燈,東西向點(diǎn)
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