ch09 內(nèi)部存儲器課件

第三章內(nèi)部存儲器存儲器概述計(jì)算機(jī)內(nèi)部用什么電路實(shí)現(xiàn)二進(jìn)制數(shù)據(jù)的存儲？存儲器是計(jì)算機(jī)中的記憶設(shè)備，它主要負(fù)責(zé)存放數(shù)據(jù)和程序。構(gòu)成存儲器的存儲介質(zhì)，目前主要采用半導(dǎo)體器件和磁性材料。存儲器中最小的存儲單位就是一個雙穩(wěn)態(tài)半導(dǎo)體電路或一個CMOS晶體管或磁性材料的存儲元，它可存儲一個二進(jìn)制代碼。由若干個存儲元組成一個存儲單元，然后再由許多存儲單元組成一個存儲器。按存儲介質(zhì)分半導(dǎo)體存儲器：用半導(dǎo)體器件組成的存儲器。磁表面存儲器：用磁性材料做成的存儲器。按存儲方式分隨機(jī)存儲器：存取時間和存儲單元的物理位置無關(guān)。順序存儲器：存取時間和存儲單元的物理位置有關(guān)。

按存儲器的讀寫功能分只讀存儲器(ROM)：只能讀出而不能寫入的半導(dǎo)體存儲器。隨機(jī)讀寫存儲器(RAM)：既能讀出又能寫入的半導(dǎo)體存儲器。按信息的可保存性分非永久記憶的存儲器：斷電后信息即消失的存儲器。永久記憶性存儲器：斷電后仍能保存信息的存儲器。按在計(jì)算機(jī)系統(tǒng)中的作用分主存儲器、輔助存儲器、高速緩沖存儲器、控制存儲器存儲器的分類1)存儲容量：指主存能存放二進(jìn)制代碼的總數(shù)。一個半導(dǎo)體觸發(fā)器可以保存一個二進(jìn)制數(shù)，稱為一個bit(位)，8個觸發(fā)器可以保存八個二進(jìn)制數(shù)，稱為一個BYTE（字節(jié)）。兩個字節(jié)稱為一個WORD（字）。2）存取時間(訪問時間)：指從一次讀（寫）操作命令發(fā)出到該操作完成將數(shù)據(jù)讀到數(shù)據(jù)緩沖寄存器為止所經(jīng)歷的時間。以ns為單位，存取時間又分讀出時間、讀入時間兩種。3）存儲周期：指存儲器連續(xù)啟動兩次獨(dú)立的操作所需間隔的最小時間，以ns為單位，存儲周期=存取時間+等待時間。4）存儲器帶寬：每秒從存儲器進(jìn)出信息的最大數(shù)量,單位為位/秒或者字節(jié)/秒。存取周期500ns，每個存取周期可訪問16位，則存儲器帶寬為：16位/(500*10-9)秒=3.2*107位/秒=32*106位/秒=32M位/秒主存儲器的技術(shù)指標(biāo)CPU與存儲器的信息交換主要依靠系統(tǒng)總線來完成，根據(jù)總線傳遞信息的不同，系統(tǒng)總線被分為數(shù)據(jù)總線，地址總線和控制總線三大類。數(shù)據(jù)總線DB(databus)：傳輸CPU與存儲器之間的二進(jìn)制數(shù)據(jù)，雙向線。數(shù)據(jù)總線的位數(shù)決定了CPU一次可以和存儲器交換數(shù)據(jù)的位數(shù)，是微型機(jī)的重要指標(biāo)。地址總線AB(addressbus):傳輸CPU送出的地址信息，用來確定和CPU交換數(shù)據(jù)的存儲單元，單向線。地址總線的位數(shù)決定了CPU可以直接尋址的內(nèi)存空間。 可尋址空間＝2n（n為地址總線的位數(shù)）控制總線CB(controlbus)：傳輸CPU發(fā)出的控制信號，包括片選信號、讀/寫信號，存儲器/IO端口訪問信號，雙向線。存儲器與CPU的連接存儲體：由存儲元按照一定的規(guī)則排列而成的矩陣，存儲體中的每一個單元只能存儲一位二進(jìn)制值。地址譯碼電路：包括地址寄存器和地址譯碼器，地址寄存器用來對地址總線的數(shù)據(jù)鎖存，地址譯碼器對地址譯碼選中存儲體中的某個確定的存儲單元，控制電路：給出讀/寫控制信號以及芯片選擇信號確定對某個存儲單元的具體操作。讀/寫電路：包括讀/寫放大器和數(shù)據(jù)寄存器，讀寫放大器對數(shù)據(jù)放大，數(shù)據(jù)寄存器暫存寫入存儲器或者從存儲器中讀出的數(shù)據(jù)。半導(dǎo)體存儲器的結(jié)構(gòu)－地址譯碼驅(qū)動方式：根據(jù)地址總線的信息選中存儲元的過程。譯碼電路0＃1＃2＃3＃A1A00010譯碼電路0＃1023＃A9A0………………單譯碼：譯碼器只有一個，譯碼器的輸出稱為字選擇線，被選單元由字選擇線直接選定，地址輸入線有N根，則能夠確定2n個字地址，該方式下譯碼輸出線過多，只適用于容量較小的存儲芯片。存儲器與CPU的連接雙譯碼：譯碼器有兩個，X譯碼器稱為行譯碼器，決定選中某行，Y譯碼器稱為列譯碼器，決定選中某列，被選單