多體交叉存儲(chǔ)器設(shè)計(jì)北京交通大學(xué)_第1頁(yè)
多體交叉存儲(chǔ)器設(shè)計(jì)北京交通大學(xué)_第2頁(yè)
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1、計(jì)算機(jī)組成原理研究性教學(xué)多體交叉存儲(chǔ)器設(shè)計(jì)北京交通大學(xué)一、多體交叉存儲(chǔ)器概述多體交叉存儲(chǔ)器，就是由多個(gè) RAM 模塊構(gòu)成，每個(gè)模塊有相同的容量和存 取速度，各模塊有各自獨(dú)立的地址寄存器、數(shù)據(jù)寄存器、地址譯碼器、驅(qū)動(dòng)和讀 寫電路，它們能并行、交叉工作。CPU在一個(gè)周期內(nèi)交叉訪問(wèn)每個(gè) RAM，若存 儲(chǔ)器由n個(gè)RAM構(gòu)成，則存儲(chǔ)器的工作速度可提高 n倍。它是在多總線結(jié)構(gòu)的 計(jì)算機(jī)中，提高系統(tǒng)的吞吐率的最有效方法。具體優(yōu)化原理： 每個(gè)存儲(chǔ)體本身存取時(shí)間并不變， 但 CPU 在全過(guò)程中交叉訪 問(wèn)各個(gè)RAM，使n個(gè)RAM的存取過(guò)程可以同時(shí)進(jìn)行，因此可以在一個(gè)存儲(chǔ)時(shí)間 內(nèi)寫入n位，相當(dāng)于提升n倍存取速度。二

2、、設(shè)計(jì)內(nèi)容及要求設(shè)計(jì)一個(gè)容量為 64KB 的采用低位交叉編址的 8 體并行結(jié)構(gòu)存儲(chǔ)器。畫出 CPU 和存儲(chǔ)芯片（芯片容量自定） 的連接圖， 并寫出圖中每個(gè)存儲(chǔ)芯片的地址范 圍（用十六進(jìn)制數(shù)表示） 。相關(guān)知識(shí)點(diǎn)：交叉存儲(chǔ)器結(jié)構(gòu)；存儲(chǔ)器并行工作原理； 譯碼電路設(shè)計(jì)；地址、 數(shù)據(jù)和控制電路設(shè)計(jì)。、設(shè)計(jì)方案 單片存儲(chǔ)芯片容量為 64KB/8 = 8KB ;地址線A0-A2作為片選信號(hào)，分別連3-8譯碼器的A、B、C端;地址線A3-A14作為塊內(nèi)地址，分別與各芯片相連；地址分配：RAM。：OOOOH、0008H、FFF8H;RAMi：0001H、0009H、FFF9H;RAM2：0002H、000AH、FFFAHRAM3：0003H、000BH、FFFBHRAM4：0004H、000CH、FFFCHRAMs：0005H、000DH、FFFDHRAM6：0006H、000EH、FFFEHRAM7：0007H、000FH、FFFFH。

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