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文檔簡介

基于FPGA的視頻的采集、處理和顯示1.利用FPGA開發(fā)板及其外部電路是實(shí)現(xiàn)PAL制式到VGA制式的轉(zhuǎn)換。系統(tǒng)框圖如圖1所示。圖像預(yù)處理模塊FPGA顯示器視頻數(shù)模轉(zhuǎn)換芯片視頻顯示控制模塊視頻捕獲模塊視頻解碼芯片攝像頭SRAM芯片SRAM芯片圖12.攝像頭采用的是CCD 攝像頭以其感光性好、靈敏度高、信噪比高、抗干擾能力強(qiáng)等優(yōu)點(diǎn)成為本文采集模塊的首選，其輸出格式為PAL（Phase Alteration Line 逐行倒相）制式的復(fù)合模擬信號。標(biāo)準(zhǔn)的PAL視頻信號圖像輸出頻率為50Hz，即每秒視頻顯示50幀。顯示一行數(shù)據(jù)所需的時(shí)間為64s。圖2給出采用的CCD攝像頭模塊。圖23、 視頻解碼芯片，即AD轉(zhuǎn)換。ADV7180是一種多用途的單芯片多格式視頻解碼器。電路圖如圖3所示。圖34. 視頻采集模塊電路板如圖4所示。圖45. 系統(tǒng)采用VGA顯示器作為視頻圖像的輸出媒介，其顯示數(shù)據(jù)為RGB三色的模擬視頻數(shù)據(jù)，而FPGA處理完成的視頻圖像數(shù)據(jù)為數(shù)字信號，視頻數(shù)模轉(zhuǎn)換芯片，采用AD公司的ADV7123作為視頻數(shù)模轉(zhuǎn)換芯片。ADV7123是一款單芯片、三通道、低功耗高速數(shù)模轉(zhuǎn)換器,內(nèi)置三個(gè)高速、10位、帶互補(bǔ)輸出的視頻數(shù)模轉(zhuǎn)換器、一個(gè)標(biāo)準(zhǔn)TTL輸入接口以及一個(gè)高阻抗、模擬輸出電流源。如圖5所示。圖56.結(jié)果圖如

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