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大連理工大學(xué)軟件學(xué)院《FPGA設(shè)計與應(yīng)用實驗》實驗報告姓名:王鑫明學(xué)號:201292223班級:軟1212姓名:席翀宇學(xué)號:201292383班級:軟1212組號: 實驗箱編號: 實驗時間:2015年5月20日實驗室:嵌入式實驗室實驗臺:SEED教學(xué)實驗平臺_指導(dǎo)教師:王潔成績:實驗2:LED點陣實驗實驗?zāi)康暮鸵笫煜SE8.2開發(fā)環(huán)境,掌握工程的生成方法;熟悉SEED-XDTK_V4實驗環(huán)境;了解HDL語言在FPGA中的使用;了解定時器的HDL實現(xiàn)。實驗內(nèi)容:定時時鐘設(shè)計;LED點陣點亮。二、實驗原理和內(nèi)容實驗內(nèi)容:定時時鐘設(shè)計;LED點陣點亮。三、主要儀器設(shè)備及軟件編程環(huán)境主要儀器設(shè)備:SEED-XDTK_V4實驗環(huán)境軟件編程環(huán)境:ISE8.2開發(fā)環(huán)境Modelsim仿真工具四、實驗步驟與編程實驗步驟:創(chuàng)建工程添加HDL資源文件編寫代碼`timescale1ns/1ps////////////////////////////////////////////////////////////////////////////////////Company://Engineer:////CreateDate:09:43:0004/18/2008//DesignName://ModuleName:dot//ProjectName://TargetDevices://Toolversions://Description:////Dependencies:////Revision://Revision0.01-FileCreated//AdditionalComments:////////////////////////////////////////////////////////////////////////////////////moduledot(CLK_IN,nRST,CPLD_E,DOT_DATA,DOT_CON,AD_nCS,DA_nCS,USB_nCS,LCD_nCS);inputCLK_IN;inputnRST; output[1:0]CPLD_E;output[15:0]DOT_DATA; output[15:0]DOT_CON; outputUSB_nCS; outputAD_nCS; outputDA_nCS; outputLCD_nCS; regCLK_OUT=1'b1; reg[15:0]DOT_CON=16'h0000; reg[15:0]DOT_DATA=16'h0000; reg[13:0]DIV_counter=14'h000; reg[3:0]cnt=4'h0; reg[13:0]cnt1=14'h000; reg[2:0]cnt2=3'h0; parameterDIV_FACTOR=14'h1f98; //CPLD功能切換assignCPLD_E=2'b11;//其他芯片功能禁止assignUSB_nCS=1'b1;assignAD_nCS=1'b1;assignDA_nCS=1'b1; assignLCD_nCS=1'b1; //時鐘分頻 always@(posedgeCLK_IN) begin if(!nRST) begin CLK_OUT<=1'b1; DIV_counter<=10'h000; end else begin if(DIV_counter<=DIV_FACTOR) begin DIV_counter<=DIV_counter+1; end else begin DIV_counter<=12'h000; CLK_OUT<=!CLK_OUT; end end end//點亮點陣 always@(posedgeCLK_OUT)begin cnt=cnt+1; cnt1=cnt1+1; if(cnt1==14'hf) begin cnt2=cnt2+1; end if(cnt2==3'h0) begin if(cnt==4'h0) begin DOT_CON<=16'h8000; DOT_DATA<=16'h0000; end elseif(cnt==4'h1) begin DOT_CON<=16'h4000; DOT_DATA<=16'hfffe; end elseif(cnt==4'h2) begin DOT_CON<=16'h2000; DOT_DATA<=16'h0104; end elseif(cnt==4'h3) begin DOT_CON<=16'h1000; DOT_DATA<=16'h0100; end elseif(cnt==4'h4) begin DOT_CON<=16'h0800; DOT_DATA<=16'h0100; end elseif(cnt==4'h5) begin DOT_CON<=16'h0400; DOT_DATA<=16'h0100; end elseif(cnt==4'h6) begin DOT_CON<=16'h0200; DOT_DATA<=16'h0100; end elseif(cnt==4'h7) begin DOT_CON<=16'h0100; DOT_DATA<=16'h0100; end elseif(cnt==4'h8) begin DOT_CON<=16'h0080; DOT_DATA<=16'h7ffc; end elseif(cnt==4'h9) begin DOT_CON<=16'h0040; DOT_DATA<=16'h0108; end elseif(cnt==4'ha) begin DOT_CON<=16'h0020; DOT_DATA<=16'h0100; end elseif(cnt==4'hb) begin DOT_CON<=16'h0010; DOT_DATA<=16'h0100; end elseif(cnt==4'hc) begin DOT_CON<=16'h0008; DOT_DATA<=16'h0100; end elseif(cnt==4'hd) begin DOT_CON<=16'h0004; DOT_DATA<=16'h0100; end elseif(cnt==4'he) begin DOT_CON<=16'h0002; DOT_DATA<=16'h7ffc; end elseif(cnt==4'hf) begin DOT_CON<=16'h0001; DOT_DATA<=16'h0008; end end /////////////////////////////////////////////// if(cnt2==3'h1) begin if(cnt==4'h0) begin DOT_CON<=16'h8000; DOT_DATA<=16'h2040; end elseif(cnt==4'h1) begin DOT_CON<=16'h4000; DOT_DATA<=16'h2040; end elseif(cnt==4'h2) begin DOT_CON<=16'h2000; DOT_DATA<=16'h2040; end elseif(cnt==4'h3) begin DOT_CON<=16'h1000; DOT_DATA<=16'h2040; end elseif(cnt==4'h4) begin DOT_CON<=16'h0800; DOT_DATA<=16'h27fc; end elseif(cnt==4'h5) begin DOT_CON<=16'h0400; DOT_DATA<=16'he040; end elseif(cnt==4'h6) begin DOT_CON<=16'h0200; DOT_DATA<=16'h2040; end elseif(cnt==4'h7) begin DOT_CON<=16'h0100; DOT_DATA<=16'h15f4; end elseif(cnt==4'h8) begin DOT_CON<=16'h0080; DOT_DATA<=16'h0a4e; end elseif(cnt==4'h9) begin DOT_CON<=16'h0040; DOT_DATA<=16'h2110; end elseif(cnt==4'ha) begin DOT_CON<=16'h0020; DOT_DATA<=16'h60a0; end elseif(cnt==4'hb) begin DOT_CON<=16'h0010; DOT_DATA<=16'h8040; end elseif(cnt==4'hc) begin DOT_CON<=16'h0008; DOT_DATA<=16'h00a0; end elseif(cnt==4'hd) begin DOT_CON<=16'h0004; DOT_DATA<=16'h1110; end elseif(cnt==4'he) begin DOT_CON<=16'h0002; DOT_DATA<=16'h33f8; end elseif(cnt==4'h
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