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1、第7章 組合邏輯電路P90,集成電路設(shè)計(jì)系列,本章概要,概述 靜態(tài)CMOS電路 鏡像電路 C2MOS 準(zhǔn)nMOS電路 動(dòng)態(tài)CMOS電路,多米諾邏輯 雙軌邏輯電路 CMOS邏輯電路的比較 多路選擇器 二進(jìn)制譯碼器 優(yōu)先權(quán)譯碼器,本章參考書,John P. Uyemura, Introduction to VLSI Circuits and Systems, John Wiley input7:0 d; output Q3; output 2:0Q; always (d) begin Q3=1; If (d7)Q=7; elseif (d6) Q=6; elseif (d5) Q=5; elsei

2、f (d4) Q=4; elseif (d3) Q=3; elseif (d2) Q=2; elseif (d1)Q=1; elseif (d0)Q=0; else begin Q3=0; Q=3b000; end end Endmodule,HDL行為描述,7.13 優(yōu)先權(quán)譯碼器 8位:描述,7.13 優(yōu)先權(quán)譯碼器 8位:門級(jí)實(shí)現(xiàn),7.13 優(yōu)先權(quán)譯碼器 8位:管級(jí)實(shí)現(xiàn),對(duì)于1個(gè)n位字，先設(shè)定各個(gè)位的優(yōu)先權(quán)次序，用輸出表示最高優(yōu)先權(quán)的輸入位的位置。,7.13 優(yōu)先權(quán)譯碼器 n位,END,第7章 組合邏輯電路,提問(wèn)題（1）,在管子尺寸、電路扇入均相同的情況下，靜態(tài)CMOS電路中的與非門、或非門哪一個(gè)更快些？為什么？ 如果一個(gè)靜態(tài)CMOS反相器的pMOS管與nMOS管的溝道尺寸一樣，其上升時(shí)間和下降時(shí)間哪一個(gè)大？為什么？ 在管子尺寸、扇入均相同的情況下，準(zhǔn)nMOS電路中的與非門、或非門哪一個(gè)輸出低電平更低？為什么？ 在CMOS邏輯電路中的電路節(jié)點(diǎn)可能處于的邏輯狀態(tài)有幾種？ 與靜態(tài)CMOS相比，動(dòng)態(tài)CMOS有什么優(yōu)點(diǎn)和缺點(diǎn)？ 時(shí)鐘信號(hào)在動(dòng)態(tài)CMOS電路中起什么作用？,提問(wèn)題（2）,與普通的動(dòng)態(tài)CMOS電路相比，

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