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1、FPGA/CPLD應(yīng)用技術(shù)應(yīng)用技術(shù)溫國忠溫國忠 、余菲、曾啟明、余菲、曾啟明晏凱、劉俐晏凱、劉俐多功能密碼鎖多功能密碼鎖按鍵與數(shù)碼管控制模塊按鍵與數(shù)碼管控制模塊設(shè)計設(shè)計曾啟明曾啟明 博士博士電子郵件:電子郵件:電話:電話鍵與數(shù)碼管控制模塊設(shè)計信號名信號名I/O位寬位寬含義含義display I8 bits七段數(shù)碼管要顯示的數(shù)據(jù)key_s O8bits鍵值scanO4 bis矩陣鍵盤和數(shù)碼管的掃描信號m O7bits七段數(shù)碼管的段碼控制信號,采用共陰數(shù)碼管keyin0 I1 bit矩陣鍵盤的輸入信號keyin1I1 bit矩陣鍵盤的輸入信號clk1I1 bit分頻后周期
2、為0.001s-0.0001s的時鐘輸出module scan_crl( display,key_s, scan, m, keyin0, keyin1, clk1);input7:0 display;output7:0 key_s;output 3:0 scan; /掃描控制output 6:0 m; /7個段碼input keyin0,keyin1,clk1;reg 3:0 scan;reg 7:0 key_s;reg 6:0 m; /產(chǎn)生用于矩陣鍵盤和動態(tài)數(shù)碼掃描的scan信號reg 1:0 st;always(posedge clk1) st=st+1b1;always (st) beg
3、in case(st) 2b00: scan=4b0001; 2b01: scan=4b0010; 2b10: scan=4b0100; 2b11: scan=4b1000; default: scan=4b0000;endcaseend代碼 (1/6)/由矩陣按鍵產(chǎn)生內(nèi)部使用的鍵值always(posedge clk1)beginif(scan=4b0001)begin if(keyin0=1b1) key_s0 =1b1; else key_s0 =1b0; if(keyin1=1b1) key_s4 =1b1; else key_s4 =1b0;endif(scan=4b0010)beg
4、in if(keyin0=1b1) key_s1 =1b1; else key_s1 =1b0; if(keyin1=1b1) key_s5 =1b1; else key_s5 =1b0;end代碼 (2/6)if(scan=4b0100)begin if(keyin0=1b1) key_s2 =1b1; else key_s2 =1b0; if(keyin1=1b1) key_s6 =1b1; else key_s6 =1b0;endif(scan=4b1000)begin if(keyin0=1b1) key_s3 =1b1; else key_s3 =1b0; if(keyin1=1b1
5、) key_s7 =1b1; else key_s7 8d199)bai7d99) bai=4d1;else bai= 7d90)shi = 7d80)shi = 7d70)shi = 7d60)shi = 7d50)shi = 7d40)shi = 7d30)shi = 7d20)shi = 7d10)shi =4d1;else shi =4d0;endassign ge= display_2wei- shi*4d10;代碼 (5/6)/BCD convert 利用bai shi ge,生成動態(tài)數(shù)碼管顯示數(shù)據(jù)“bin”reg4:0bin;always (st,ge,shi,bai) begin case(st) 2b00: bin=4b0000; 2b01: bin=bai; 2b10: bin=shi; 2b11: bin=ge; default: bin=4b0000;endcaseendalways (bin) /七段數(shù)碼管譯碼模塊begin case (bin) 4b0000:m=7b0111111; 4b0001:m=7b0000110; 4b0010:m=7b1011011;4b0011:m=7b1001111; 4b0100:m=7b1100110;4b0101:m=7b1101101; 4b0110:m=7b1111101;4b0111:m=7b0000111
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