FPGA的CMOS圖像傳感器控制時(shí)序的設(shè)計(jì)

1、【W(wǎng)ord版本下載可任意編輯】 FPGA的CMOS圖像傳感器控制時(shí)序的設(shè)計(jì)CMOS圖像傳感器產(chǎn)生于20世紀(jì)80年代，由于當(dāng)時(shí)CMOS工藝的制造技術(shù)不高，以至于傳感器在應(yīng)用中的雜訊較大，商品化的進(jìn)程一直很慢。至今，隨著工藝的不斷提高，CMOS圖像傳感器的應(yīng)用范圍也不斷擴(kuò)大，涉及到數(shù)碼產(chǎn)品、通訊、工業(yè)，醫(yī)療等各領(lǐng)域。與CCD相比，CMOS圖像傳感器具有體積小，功耗低，成本低等特點(diǎn)。Cypress公司的CMOS圖像傳感器IBIS5-B-1300是一款高性能、大動(dòng)態(tài)范圍的圖像傳感器。圖像傳感器的正常工作需要有正確的驅(qū)動(dòng)時(shí)序信號(hào)，本文就圖像傳感器IBIS5-B-1300，給出采用VHDL語(yǔ)言設(shè)計(jì)的驅(qū)動(dòng)時(shí)

2、序和仿真結(jié)果。 1 IBIS5-B-1300圖像傳感器 1.1 芯片簡(jiǎn)介 Cypress公司的IBIS5-B-1300將模擬圖像獲取、數(shù)字化和數(shù)字信號(hào)處理的功能集成在單一芯片中，是一款高性能的CMOS圖像傳感器。這款130萬(wàn)像素（1 2801 024）的 圖像傳感器可以采用SXGA或VGA格式輸出，幀頻可達(dá)27.5 fs（1 2801 024）或106 fs（640480）。 其主要特點(diǎn)如下： （1）6.7m的高填充因子像素單元。它可使器件的靈敏度較高，噪聲較小。 （2）高的動(dòng)態(tài)范圍（單斜率積分下為64 dB）。當(dāng)采用雙斜率積分或多斜率積分時(shí)，動(dòng)態(tài)范圍可進(jìn)一步提高。 （3）片載可調(diào)整增益和偏置

3、的輸出放大器。它能使信號(hào)的抖動(dòng)限制在片載10 b ADC的輸入范圍之內(nèi)。 （4）片載40 MHz的10 b ADC。它可直接對(duì)輸出模擬信號(hào)開(kāi)展模數(shù)轉(zhuǎn)換，該ADC在電氣上與圖像傳感器分離，如果需要，可選擇不經(jīng)模數(shù)轉(zhuǎn)換而直接輸出模擬信號(hào)。 （5）隨機(jī)開(kāi)窗模式和亞采樣模式。隨機(jī)開(kāi)窗模式可以只對(duì)感興趣的區(qū)域開(kāi)展讀出；亞采樣模式可以很好地滿足圖像壓縮的需要。 （6）片載時(shí)序與控制邏輯序列發(fā)生器、內(nèi)部存放器。它可使得設(shè)計(jì)者用較少的信號(hào)來(lái)控制傳感器的工作。 1.2 工作原理 IBIS5-B-1300內(nèi)部有12個(gè)存放器，提供傳感器工作所需的參數(shù)及工作方式。對(duì)存放器寫(xiě)入的數(shù)據(jù)決定了傳感器的工作狀態(tài)。存放器的數(shù)據(jù)

4、寫(xiě)入接口有3種：并行接口、串 行三線接口、串行兩線接口?？赏ㄟ^(guò)芯片的IF_MODE和SER_MODE管腳接不同的值來(lái)選擇不同的數(shù)據(jù)接口模式（如下表1所示）。 并行接口使用16 b并行輸入來(lái)載入新的存放器值。串行3線接口（或串轉(zhuǎn)并接口）使用串行接口將數(shù)據(jù)移入存放器緩沖器，當(dāng)完整的數(shù)據(jù)字移入存放器緩沖器時(shí)，數(shù)據(jù)字才 被載入當(dāng)前正在編碼的存放器。串行2線是一個(gè)單向的接口，本文暫不做分析。 IBIS5-B-1300具有兩種快門(mén)方式：卷簾快門(mén)和同步快門(mén)，用存放器（0000）的bitO開(kāi)展設(shè)定，“1”為卷簾快門(mén)，“0”為同步快門(mén)。時(shí)序如圖1，圖2所示。 在卷簾快門(mén)模式下，幀頻Frame period=（N

5、r.Lines（RBT+Pixel Period*Nr.Pixels）。 在同步快門(mén)模式下，幀頻Frame period=“Tint”+Tread out=“TInt”+（Nr.Lines（RBT+Pixel PeriodNr.Pixels）。其中，TInt為積分（曝光）時(shí)間；Nr.Lines為每幀讀出的行數(shù)；Nr.Pixels為每行讀出的像素?cái)?shù)；RBT為行空白時(shí)間（典型值為3.5 ms）；Pixel Period為140 MHz=“25” ns。 卷簾快門(mén)中有兩個(gè)y方向的移位存放器，一個(gè)指向正在被讀出的行，另一個(gè)指向正在被復(fù)位的行，兩個(gè)指針由同一時(shí)鐘y_clock（行時(shí)鐘）驅(qū)動(dòng)，它們之間的差

6、值代表了光積分時(shí)間。在卷簾快門(mén)模式下，像素的讀出和復(fù)位同時(shí)開(kāi)展，每行像素的復(fù)位和讀出是順序開(kāi)展的（見(jiàn)圖3）。像素的積分時(shí)間可以通過(guò)存放器INT_TIME來(lái)修改。在這種模式下，像素在不同的時(shí)刻感光，因而在采集動(dòng)態(tài)圖像時(shí)會(huì)產(chǎn)生模糊。 同步快門(mén)模式下，所有像素的光積分在同一時(shí)刻開(kāi)展的。所有像素同時(shí)被復(fù)位，在經(jīng)過(guò)光積分后，像素的值被存儲(chǔ)在每個(gè)像素的存儲(chǔ)節(jié)點(diǎn)上，然后逐行依次讀出。像素的光積分和讀出是串行的，在像素讀出時(shí)，積分被禁止，因而可以防止卷簾快門(mén)所產(chǎn)生的動(dòng)態(tài)圖像模糊的問(wèn)題。此外，同步快門(mén)支持多斜率積分，可獲得比卷簾快門(mén)更高的動(dòng)態(tài)范圍。 綜上分析，在使用這款成像器芯片時(shí)，對(duì)快門(mén)方式要根據(jù)應(yīng)用的場(chǎng)合開(kāi)

7、展選擇，在對(duì)快速運(yùn)動(dòng)的物體開(kāi)展捕獲或要求有高的動(dòng)態(tài)范圍時(shí)應(yīng)選擇同步快門(mén)；而在對(duì)圖像的幀速 率要求較高或要對(duì)圖像開(kāi)展連續(xù)采集時(shí)應(yīng)選擇卷簾快門(mén)。 2 基于FPGA的CMOS控制時(shí)序的設(shè)計(jì) 2.1 現(xiàn)場(chǎng)可編程門(mén)陣列FPGA 隨著集成電路的發(fā)展，大規(guī)?？删幊踢壿嬈骷V泛用于電路設(shè)計(jì)領(lǐng)域，它具有功耗低，可靠性高的特點(diǎn)，同時(shí)大大減小了電路板的尺寸。FPGA的內(nèi)部構(gòu)造決定了FPGA在時(shí)序設(shè)計(jì)方面的優(yōu)越性。該設(shè)計(jì)選用Xilinx公司的Spartan3系列FPGA芯片XC3$50作為硬件設(shè)計(jì)平臺(tái)。Spar-tan3基于VirtexFPGA架構(gòu)，采用90 nm技術(shù)，8層金屬工藝，內(nèi)嵌硬核乘法器和數(shù)字時(shí)鐘管理模塊。

8、從構(gòu)造上看，它將邏輯、存儲(chǔ)器、數(shù)字運(yùn)算、數(shù)字處理器、IO以及系統(tǒng)管理資源完美地結(jié)合在一起，使之具有更高層次、更廣泛的應(yīng)用。 2.2 控制時(shí)序的設(shè)計(jì) 該設(shè)計(jì)采用VHDL硬件描述語(yǔ)言，根據(jù)自頂向下的設(shè)計(jì)方法，將時(shí)序控制部分分為三個(gè)模塊：復(fù)位模塊、存放器配置模塊和快門(mén)模塊。由于存放器有兩種配置方式，快門(mén)模式也有兩種，因而后兩部分都可以再細(xì)分為兩個(gè)小模塊。三個(gè)大的模塊有嚴(yán)格的先后關(guān)系，必須在前一模塊已完成后，才可開(kāi)始后一模塊。圖4顯示模塊的劃分及其關(guān)系。 復(fù)位模塊是用來(lái)產(chǎn)生圖像傳感器所需的SYS_RE_SET信號(hào)，使傳感器正常復(fù)位，內(nèi)部存放器清零，為存放器的配置做好準(zhǔn)備。 存放器配置模塊是用來(lái)配置圖像

9、傳感器內(nèi)部的12個(gè)存放器，提供傳感器工作所需的參數(shù)和方式。其中，參數(shù)有積分時(shí)間、積分方式（單斜率或多斜率）、X序列發(fā)生器的時(shí)鐘間隔、SS序列發(fā)生器的時(shí)鐘間隔、亞采樣方式、開(kāi)窗位置及大小等。 快門(mén)模塊用于產(chǎn)生傳感器工作所需的一些控制信號(hào)，針對(duì)快門(mén)方式的不同給出所需的時(shí)序控制信號(hào)。在同步快門(mén)的設(shè)計(jì)中，該設(shè)計(jì)采用單斜率積分，在此設(shè)計(jì)根底上多斜率積分容易實(shí)現(xiàn)。 該設(shè)計(jì)采用VHDL對(duì)各模塊時(shí)序開(kāi)展編程。其中，快門(mén)模塊使用狀態(tài)機(jī)來(lái)實(shí)現(xiàn)各狀態(tài)之間的轉(zhuǎn)換（圖5顯示了卷簾模塊的狀態(tài)轉(zhuǎn)移圖，圖6顯示了同步快門(mén)的狀態(tài)轉(zhuǎn)移圖）。全局時(shí)鐘和ADC時(shí)鐘采用DCM即數(shù)字時(shí)鐘管理單元來(lái)實(shí)現(xiàn)。 3 實(shí)驗(yàn)結(jié)果 3.1 仿真結(jié)果 時(shí)序控制電路設(shè)計(jì)完畢后，需要對(duì)各部分開(kāi)展功能仿真、邏輯綜合以及綜合后仿真，對(duì)整個(gè)系統(tǒng)開(kāi)展綜合、布局布線，完成時(shí)序仿真。對(duì)各模塊編程并仿真通過(guò)后，將各模塊加載到主函數(shù)top中，采用并行的存放器配置方式，對(duì)卷簾和同步兩種快門(mén)方式開(kāi)展仿真，在Modelsim中的仿真結(jié)果如圖7，圖8所示。 3.2 成像結(jié)果 將此驅(qū)動(dòng)時(shí)序應(yīng)用于相機(jī)系統(tǒng)，在全幀輸出模式（1 2801 024）下，對(duì)鑒別率靶和靜物開(kāi)展拍攝，實(shí)驗(yàn)結(jié)果如圖9，圖10所示。由所拍攝結(jié)果可以看出，圖像清晰穩(wěn)定，無(wú)明顯變形，CMOS圖像傳感器滿足了成像的需求。 4 結(jié)語(yǔ) 圖