915MHz RFID讀寫器解碼的FPGA設(shè)計(jì)與實(shí)現(xiàn)-設(shè)計(jì)應(yīng)用_第1頁
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精品文檔-下載后可編輯MHzRFID讀寫器解碼的FPGA設(shè)計(jì)與實(shí)現(xiàn)-設(shè)計(jì)應(yīng)用

由于TypeA型和TypeB型915MHzREID讀寫器接收的來自于電子標(biāo)簽的信息都是采用FM0編碼，因此915MHzRFID讀寫器的解碼即是對(duì)接收信息進(jìn)行FM0解碼。由于FM0編碼的特點(diǎn)，信號(hào)“0”和信號(hào)“1”明顯的不同是在位窗中部有電平跳變，因此只需要使用二倍頻時(shí)鐘在上升沿對(duì)輸入信號(hào)進(jìn)行兩次抽樣。如果兩次抽樣的數(shù)值相等，則應(yīng)該輸出信號(hào)“1”；否則，輸出信號(hào)“0”。以下是對(duì)數(shù)據(jù)進(jìn)行FM0解碼的VHDL程序。

從以上的程序可以看出，利用數(shù)字邏輯的基本原理實(shí)現(xiàn)數(shù)據(jù)的FM0解碼是比較簡(jiǎn)單的，只是還需要將buffer數(shù)據(jù)回讀到系統(tǒng)內(nèi)，以便進(jìn)一步處理。

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