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基于FPGA多功能試驗測試開發(fā)板

指導教師：王軍研究成員：2010年3月30日

1項目研究的主要內(nèi)容2項目研究的特色與創(chuàng)新34項目研究的收獲與體會項目研究的目的和意義報告主要內(nèi)容1項目研究的目的和意義現(xiàn)場可編程邏輯門陣列CLB、IOB、內(nèi)部連線靈活、集成度高、適用范圍廣、大規(guī)模電路缺點:功能單一本實驗板將預留多組I/O接口2.1硬件設(shè)計—測頭信號A/D轉(zhuǎn)換位數(shù)16bitREF4.096V輸出方式串行AIN0~REF最大速度85ksps(1.7M)轉(zhuǎn)換方式異步、同步輸入A/D轉(zhuǎn)換器MAX195輸出光耦DS12332.2硬件設(shè)計—光柵信號差分接收ABMC3486光柵傳感器信號接收電路2.3硬件設(shè)計—FIFO接口位擴展半滿中斷數(shù)據(jù)雙向控制IDT7206接口示意圖2.4.1FPGA控制邏輯—AD模塊MAX195A/D轉(zhuǎn)換控制模塊時鐘分頻功能仿真圖2.4.2FPGA控制邏輯—光柵模塊數(shù)字濾波細分辨向可逆計數(shù)光柵信號數(shù)字濾波器的功能仿真四細分原理圖

辨向狀態(tài)轉(zhuǎn)換圖(2)光柵信號細分、辨向（3）光柵信號可逆計數(shù)正向運動反向運動

正交光柵可逆計數(shù)四細分計數(shù)仿真圖3課題研究的特色與創(chuàng)新

功能多樣化、方便了同學設(shè)計電路配有多組輸入輸出端，方便同學自主設(shè)計4課題研究的收獲與體會

1電路設(shè)計

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