模擬集成電路設計 魏廷存 第6章習題(含答案)_第1頁
模擬集成電路設計 魏廷存 第6章習題(含答案)_第2頁
模擬集成電路設計 魏廷存 第6章習題(含答案)_第3頁
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模擬集成電路設計 魏廷存 第6章習題(含答案)_第5頁
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文檔簡介

6.1圖6.39(a)、(b)、(c)、(d)為比較器的輸入-輸出關系曲線,如果比較器的輸入-輸出關系取反,試畫出此時的輸入-輸出關系曲線。圖6.39參考答案:6.2對于圖6.40所示比較器,假定M5的直流電流為100μA,W6/L6=5(W4/L4),W8/L8=5(W3/L3),且CL=10pF,VDD=4V,求比較器的傳輸時延。這里假設比較器的輸入信號幅度足夠大,導致比較器出現(xiàn)“轉(zhuǎn)換”現(xiàn)象,即時延由擺率SR決定。圖6.40解:當該比較器處于靜態(tài)工作時,M6和M7管的靜態(tài)偏置電流為:當該比較器工作在大信號擺幅的情況下,最大的source電流為:最大的sink電流為:當給Vin的正端加一個正向的大信號時,M6導通,M7截止,此時對電容CL進行充電,電容可以充電到VDD,此時的輸出電壓:即當給Vin正端加一個負向的大信號時,此時M7導通,M6截止,此時電容CL進行放電,電容放電到0V,此時的輸出電壓:即該比較器的傳輸延時為:6.3對于圖6.30所示外部正反饋遲滯比較器(反向輸入),試推導該比較器的正、負遲滯電壓。6.4對于圖6.31所示外部正反饋遲滯比較器(同向輸入,且遲滯曲線發(fā)生位移),試推導該比較器的正、負遲滯電壓以及電壓位移量。6.5對于圖6.41所示的外部正反饋遲滯比較器,假定VOH=2V,VOL=-2V,上轉(zhuǎn)折點為1V,下轉(zhuǎn)折點為0V。求電阻R1和R2之間的關系以及參考電壓VREF。圖6.41解:上部(向下)翻轉(zhuǎn)點:下部(向上)翻轉(zhuǎn)點:解得:6.6設計圖6.8所示的由三級開環(huán)運放構(gòu)成的比較器。要求小信號差模電壓增益Avd>80dB,其它參數(shù)自定。CMOS管的參數(shù)為:μnCox=151μA/V2,μpCox=54μA/V2,VTHN,P=±0.70V。6.7設計圖6.42所示的輸入級為NMOS管的內(nèi)部正反饋遲滯比較器。假定電流I5=5μA,要求VTRP+>0.1V,VTRP-<-0.1V,小信號差模電壓增益Avd>60dB,其它參數(shù)自定。CMOS管的參數(shù)與題6.6相同。圖6.42(解:(1)假定M1的柵極接0電位,M2的柵極電位遠小于0,則M1、M3導通,M6工作在深度線性區(qū),而M2、M4、M7截止,此時輸出VO2為高電平;隨著Vin增加,M2逐漸導通,i2逐漸增大,最后M2完全導通,當i2=i6時,正遲滯(翻轉(zhuǎn))點發(fā)生。由于則有:可得:可得:由于M1和M2工作在飽和區(qū),i1和i2為:假設M1和M2的尺寸和特性對稱,即則VTRP+可表示為:將代入上式(2)假定M1的柵極接0電位,M2的柵極電位遠大于0,則M2、M4導通,M7工作在深度線性區(qū),而M1、M3、M6截止,此時輸出VO1為高電平;隨著Vin減小,M1逐漸導通,i1逐漸增大,最后M1完全導通,當i1=i7時,負遲滯(翻轉(zhuǎn))點發(fā)生。由于則有:可得:可得:由于M1和M2工作在飽和區(qū),i1和i2為:假設M1和M2的尺寸和特性對稱,即則VTRP+可表示為:將代入上式(3)根據(jù)題目要求,電流i5=5uA,要求VTRP+>0.1V,VTRP-<-0.1V,代入得取L=1um,W=2um解得:α=5代入得:上述結(jié)果滿足題意要求。則該比較器各晶體管的參數(shù)為:晶體管溝道長度(um)寬長比fingermultiplierM1,212:111M3,412:111M6,7110:111M5,822:111偏置電流源

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