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實(shí)驗(yàn)四JK觸發(fā)器的應(yīng)用設(shè)計(jì),一、實(shí)驗(yàn)?zāi)康?熟悉并驗(yàn)證觸發(fā)器的邏輯功能及相互轉(zhuǎn)換的方法 掌握集成JK觸發(fā)器邏輯功能的測(cè)試方法 學(xué)習(xí)用JK觸發(fā)器構(gòu)成簡(jiǎn)單時(shí)序邏輯電路的方法 進(jìn)一步熟悉用雙蹤示波器測(cè)量多個(gè)波形的方法,二、實(shí)驗(yàn)元器件： 雙JK觸發(fā)器：4027 1片(引腳圖見實(shí)驗(yàn)教材P104),CC4027功能表,三、實(shí)驗(yàn)內(nèi)容：,1、 按JK觸發(fā)器邏輯功能表驗(yàn)證JK 觸發(fā)器的邏輯功能,JK觸發(fā)器特性方程和功能表,2、設(shè)計(jì)二分頻、四分頻電路：將第二個(gè)JK觸發(fā)器的J、K端連接在一起接到第一個(gè)觸發(fā)器的Q，輸入1KHZ方波。畫出實(shí)驗(yàn)電路圖，測(cè)繪CP、Q1、Q2的波形，標(biāo)出幅值和周期，理解二分頻、四分頻的概念。,四、注意事項(xiàng)： 1、VDD接電源正極，VSS接電源負(fù)極（通常接地），電源絕對(duì)不允許接反。實(shí)驗(yàn)一般要求為+5V電源。 2、所有輸入端一律不準(zhǔn)懸空。 3、不使用的輸入端應(yīng)按邏輯要求直接接VDD或VSS，在工作速度不高的電路中，允許輸入端并聯(lián)使用。 4、輸出端不允許直接與VDD或VSS連接，不允許兩個(gè)器件輸出端連接使用。 5、示波器觀察多個(gè)波形時(shí)，注意選用頻率最低的電壓作觸發(fā)電壓。,思考題 如何將JK觸發(fā)器轉(zhuǎn)換成T觸發(fā)器和D 觸發(fā)器？,實(shí)驗(yàn)五 N進(jìn)制計(jì)數(shù)器的設(shè)計(jì),JK觸發(fā)器的應(yīng)用設(shè)計(jì),實(shí)驗(yàn)?zāi)康模?同前面,實(shí)驗(yàn)原理：實(shí)驗(yàn)教材 Page 98,實(shí)驗(yàn)內(nèi)容： 題目、邏輯功能表、電路圖、

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